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参数资料
| 型号： | ADSP-21160MKB-80 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 21/52页 |
| 文件大小： | 0K |
| 描述： | IC DSP CONTROLLER 32BIT 400 BGA |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | 主机接口，连接端口，串行端口 |
| 时钟速率： | 80MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 512kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 2.50V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-BBGA |
| 供应商设备封装： | 400-PBGA（27x27） |
| 包装： | 托盘 |
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ADSP-21160M
–28–
REV. 0
Asynchronous Read/Write—Host to ADSP-21160M
chronous host processor accesses of an ADSP-21160M,
after the host has asserted CS and HBR (low). After HBG
is returned by the ADSP-21160M, the host can drive the
RDx and WRx pins to access the ADSP-21160M’s internal
memory or IOP registers. HBR and HBG are assumed low
for this timing
Table 14. Read Cycle
Parameter
Min
Max
Unit
Timing Requirements:
t
SADRDL
Address Setup/CS Low Before RDx Low
0
ns
t
HADRDH
Address Hold/CS Hold Low After RDx
2ns
t
WRWH
RDx/WRx High Width
5ns
t
DRDHRDY
RDx High Delay After REDY (O/D) Disable
0ns
t
DRDHRDY
RDx High Delay After REDY (A/D) Disable
0ns
Switching Characteristics:
t
SDATRDY
Data Valid Before REDY Disable from Low
2
ns
t
DRDYRDL
REDY (O/D) or (A/D) Low Delay After RDx Low
10
ns
t
RDYPRD
REDY (O/D) or (A/D) Low Pulsewidth for Read
t
CK
ns
t
HDARWH
Data Disable After RDx High
26ns
Figure 20. Read Cycle (Asynchronous Read—Host to ADSP-21160M)
5( $ ' & < & /(
5('< 2'
5';
$''5(66&6
'$7$ 2 87
5('< $'
W6$'5'/
W'5'<5'/
W:5:+
W+$'5'+
W+'$5:+
W5'<35'
W'5'+5'<
W6'$75'<
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ADSP-21160N | 制造商:AD 制造商全称:Analog Devices 功能描述:DSP Microcomputer |
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| ADSP-21160NCB-TBD | 制造商:AD 制造商全称:Analog Devices 功能描述:DSP Microcomputer |
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