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参数资料
| 型号： | ADSP-21261SKSTZ150 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 13/44页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 150MHZ 144LQFP |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 60 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，SPI |
| 时钟速率： | 150MHz |
| 非易失内存： | ROM（384 kB） |
| 芯片上RAM： | 128kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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Rev. 0
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March 2006
ADSP-21261
Reset
Interrupts
FLAG0, FLAG1, and FLAG2 pins when they are configured as
IRQ0, IRQ1, and IRQ2 interrupts. Also applies to DAI_P20–1
pins when configured as interrupts.
Core Timer
FLAG3 when it is configured as the core timer (CTIMER).
Table 11. Reset
Parameter
Min
Max
Unit
Timing Requirements
tWRST
RESET Pulse Width Low
1
4tCK
ns
tSRST
RESET Setup Before CLKIN Low
8
ns
1 Applies after the power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 100
μs while RESET is low, assuming
stable VDD and CLKIN (not including start-up time of external clock oscillator).
Figure 9. Reset
CLKIN
RESET
tWRST
tSRST
Table 12. Interrupts
Parameter
Min
Max
Unit
Timing Requirement
tIPW
IRQx Pulse Width
2 × tCCLK +2
ns
Figure 10. Interrupts
DAI_P20–1
(FLAG2–0)
(IRQ2–0)
tIPW
Table 13. Core Timer
Parameter
Min
Max
Unit
Switching Characteristic
tWCTIM
CTIMER Pulse Width
4 × tCCLK – 1
ns
Figure 11. Core Timer
FLAG3
(CTIMER)
tWCTIM
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PDF描述 |
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