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参数资料
| 型号： | ADSP-21261SKSTZ150 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 28/44页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 150MHZ 144LQFP |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 60 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，SPI |
| 时钟速率： | 150MHz |
| 非易失内存： | ROM（384 kB） |
| 芯片上RAM： | 128kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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Rev. 0
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March 2006
ADSP-21261
SPI Protocol—Master
SPI Protocol—Slave
See Table 30 and Figure 26.
Table 29. SPI Protocol—Master
Parameter
Min
Max
Unit
Timing Requirements
tSSPIDM
Data Input Valid to SPICLK Edge (Data Input Setup Time)
5
ns
tHSPIDM
SPICLK Last Sampling Edge to Data Input Not Valid
2
ns
Switching Characteristics
tSPICLKM
Serial Clock Cycle
8 × tCCLK
ns
tSPICHM
Serial Clock High Period
4 × tCCLK – 2
ns
tSPICLM
Serial Clock Low Period
4 × tCCLK – 2
ns
tDDSPIDM
SPICLK Edge to Data Out Valid (Data Out Delay Time)
3
ns
tHDSPIDM
SPICLK Edge to Data Out Not Valid (Data Out Hold Time)
10
ns
tSDSCIM
FLAG3–0 OUT (SPI Device Select) Low to First SPICLK Edge
4 × tCCLK – 2
ns
tHDSM
Last SPICLK Edge to FLAG3–0 OUT High
4 × tCCLK – 1
ns
tSPITDM
Sequential Transfer Delay
4 × tCCLK – 1
ns
Figure 25. SPI Protocol—Master
LSB
VALID
MSB
VALID
tSSPIDM
tHSPIDM
tHDSPIDM
LSB
MSB
tHSPIDM
tDDSPIDM
MOSI
(OUTPUT)
MISO
(INPUT)
FLAG3–0
(OUTPUT)
SPICLK
(CP = 0)
(OUTPUT)
SPICLK
(CP = 1)
(OUTPUT)
tSPICH M
tSPIC LM
tSPICLKM
tSPICHM
tHDSM
tSPITDM
tHDSPIDM
LSB
VALID
LSB
MSB
VALID
tH SPID M
tDDSPIDM
MOSI
(OUTPUT)
MISO
(INPUT)
tSSPIDM
CPHASE = 1
CPHASE = 0
tSD SCIM
tSSPID M
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