参数资料
| 型号： | CDB4245 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 31/59页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS4245 CODEC |
| 标准包装： | 1 |
| 主要目的： | 音频编解码器 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | CS4245 |
| 主要属性： | 4 个单端模拟和 1 个麦克风输入和 8 个输出，S/PDIF 发射器和接收器 |
| 次要属性： | 图形用户界面 |
| 已供物品： | 板 |
| 产品目录页面： | 754 (CN2011-ZH PDF) |
| 相关产品： | CS4245-DQZR-ND - IC CODEC AUD STER 104DB 48-LQFP 598-1616-ND - IC CODEC AUD STER 104DB 48LQFP 598-1034-ND - IC CODEC AUD STER 104DB 48LQFP |
| 其它名称： | 598-1501 |
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CS4245
in Master Mode, and receive the proper clocks in Slave Mode. Table 2 illustrates several standard audio
sample rates and the required MCLK and LRCK frequencies.
LRCK
MCLK (MHz)
(kHz)
32
44.1
48
64
88.2
96
128
176.4
192
64x
-
-
-
-
-
-
8.1920
11.2896
12.2880
96x
-
-
-
-
-
-
12.2880
16.9344
18.4320
128x
-
-
-
8.1920
11.2896
12.2880
16.3840
22.5792
24.5760
192x
-
-
-
12.2880
16.9344
18.4320
24.5760
33.8680
36.8640
256x
8.1920
11.2896
12.2880
16.3840
22.5792
24.5760
32.7680
45.1584
49.1520
384x
12.2880
16.9344
18.4320
24.5760
33.8680
36.8640
-
-
-
512x
16.3840
22.5792
24.5760
32.7680
45.1584
49.1520
-
-
-
768x
24.5760
33.8680
36.8640
-
-
-
-
-
-
1024x
32.7680
45.1584
49.1520
-
-
-
-
-
-
Mode
QSM
DSM
SSM
Table 2. Common Clock Frequencies
In both Master and Slave Modes, the external MCLK must be divided down based on the MCLK/LRCK
ratio to achieve a post-divider MCLK/LRCK ratio of 256x for SSM, 128x for DSM, or 64x for QSM. Table 3
lists the appropriate dividers.
MCLK/LRCK Ratio
MCLK Dividers
64x
96x
128x
192x
256x
384x
512x
768x
1024x
Mode
-
-
-
-
÷1
÷1.5
÷2
÷3
÷4
SSM
-
-
÷1
÷1.5
÷2
÷3
÷4
-
-
DSM
÷1
÷1.5
÷2
÷3
÷4
-
-
-
-
QSM
Table 3. MCLK Dividers
DS656F3
31
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