参数资料
| 型号： | CDB4245 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 46/59页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR CS4245 CODEC |
| 标准包装： | 1 |
| 主要目的： | 音频编解码器 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | CS4245 |
| 主要属性： | 4 个单端模拟和 1 个麦克风输入和 8 个输出，S/PDIF 发射器和接收器 |
| 次要属性： | 图形用户界面 |
| 已供物品： | 板 |
| 产品目录页面： | 754 (CN2011-ZH PDF) |
| 相关产品： | CS4245-DQZR-ND - IC CODEC AUD STER 104DB 48-LQFP 598-1616-ND - IC CODEC AUD STER 104DB 48LQFP 598-1034-ND - IC CODEC AUD STER 104DB 48LQFP |
| 其它名称： | 598-1501 |
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CS4245
6.5.2
Master Clock 2 Frequency (Bits 2:0)
Function:
These bits set the frequency of the supplied MCLK2 signal. See Table 13 for the appropriate settings.
MCLK2 Divider
MCLK2 Freq2 MCLK2 Freq1 MCLK2 Freq0
÷1
÷ 1.5
÷2
÷3
÷4
Reserved
Reserved
0
0
0
0
1
1
1
0
0
1
1
0
0
1
0
1
0
1
0
1
x
Table 13. MCLK 2 Frequency
6.6
Signal Selection - Address 06h
7
Reserved
6
AOutSel1
5
AOutSel0
4
Reserved
3
Reserved
2
Reserved
1
LOOP
0
ASynch
6.6.1
Auxiliary Output Source Select (Bits 6:5)
Function:
AOutSel1
0
0
1
1
AOutSel0
0
1
0
1
Auxiliary Output Source
High Impedance
DAC Output
PGA Output
Reserved
Table 14. Auxiliary Output Source Selection
6.6.2
6.6.3
46
Digital Loopback (Bit 1)
Function:
When this bit is set, an internal digital loopback from the ADC to the DAC are enabled. Please refer to
Asynchronous Mode (Bit 0)
Function:
When this bit is set, the DAC and ADC may be operated at independent asynchronous sample rates de-
rived from MCLK1 and MCLK2. When this bit is cleared, the DAC and ADC must operate at synchronous
sample rates derived from MCLK1.
DS656F3
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