参数资料
| 型号： | CORE10/100-AR |
| 厂商： | Microsemi SoC |
| 文件页数： | 30/106页 |
| 文件大小： | 0K |
| 描述： | IP CORE10/100 UNLIMITED RTL |
| 标准包装： | 1 |
| 系列： | * |
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Software Interface
Bits 31:24
Bits 23:16
Bits 15:8
Bits 7:0
Table 4-9 · Receive Descriptor List Base Address Register (CSR3)
RLA(31..24)
RLA(23..16)
RLA(15..8)
RLA(7..0)
Table 4-10 · Receive Descriptor List Base Address Register Bit Functions
Core10100 v4.0
Bit
CSR3.(31..0)
Symbol
RLA
Function
Start of the receive list address
Contains the address of the first descriptor in a receive descriptor list. This address must be
longword-aligned (RLA(1..0) = 00).
Table 4-11 · Transmit Descriptor List Base Address Register (CSR4)
Bits 31:24
Bits 23:16
Bits 15:8
Bits 7:0
TLA(31..24)
TLA(23..16)
TLA(15..8)
TLA(7..0)
Table 4-12 · Transmit Descriptor List Base Address Register Bit Functions
Bit
CSR4.(31..0)
Symbol
TLA
Function
Start of the transmit list address
Contains the address of the first descriptor in a transmit descriptor list. This address must
be longword-aligned (TLA(1..0) = 00).
Table 4-13 · Status Register (CSR5)
Bits 31:24
Bits 23:16
TS
RS
NIS
Bits 15:8
AIS
ERI
GTE
ETI
RPS
Bits 7:0
RU
RI
UNF
TU
TPS
TI
30
Note:
The CSR5 register has unimplemented bits (shaded). If these bits are read, they will return a predefined value. Writing
to these bits has no effect.
v4.0
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PDF描述 |
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