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参数资料
| 型号： | CY7C1248KV18-400BZXC |
| 厂商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分类： | SRAM |
| 英文描述： | 2M X 18 DDR SRAM, 0.45 ns, PBGA165 |
| 封装： | 13 X 15 MM, 1.40 MM HEIGHT, LEAD FREE, MO-216, FBGA-165 |
| 文件页数： | 27/28页 |
| 文件大小： | 907K |
| 代理商： | CY7C1248KV18-400BZXC |
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CY7C1246KV18, CY7C1257KV18
CY7C1248KV18, CY7C1250KV18
Document Number: 001-57834 Rev. *B
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DOFF
Input
PLL turn off
active LOW. Connecting this pin to ground turns off the PLL inside the device. The timing
in the PLL turned off operation differs from those listed in this data sheet. For normal operation, this pin
can be connected to a pull up through a 10 K
or less pull-up resistor. The device behaves in DDR I
mode when the PLL is turned off. In this mode, the device can be operated at a frequency of up to 167 MHz
with DDR I timing.
TDO
Output
TDO for JTAG
TCK
Input
TCK pin for JTAG
TDI
Input
TDI pin for JTAG
TMS
Input
TMS pin for JTAG
NC
N/A
Not connected to the die. Can be tied to any voltage level.
NC/144M
Input
Not connected to the die. Can be tied to any voltage level.
NC/288M
Input
Not connected to the die. Can be tied to any voltage level.
VREF
Input-
reference
Reference voltage input. Static input used to set the reference level for HSTL inputs, outputs, and AC
measurement points.
VDD
Power supply Power supply inputs to the core of the device
VSS
Ground
Ground for the device
VDDQ
Power supply Power supply inputs for the outputs of the device
Table 2. Pin Definitions (continued)
Pin Name
I/O
Pin Description
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