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参数资料
| 型号： | DS2152L+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 58/97页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1CHIP ENHNCD 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 功能： | 单芯片收发器 |
| 接口： | T1 |
| 电路数： | 1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 电流 - 电源： | 75mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 管件 |
| 包括： | DSX-1 和 CSU 线路补偿发生器，HDLC 控制器，带内回路代码发生器和检测器 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS2152
61 of 97
FDLS: FDL STATUS REGISTER (Address = 01 Hex)
(MSB)
(LSB)
RBOC
RPE
RPS
RHALF
RNE
THALF
TNF
TMEND
SYMBOL
POSITION
NAME AND DESCRIPTION
RBOC
FDLS.7
Receive BOC Detector Change of State. Set whenever the
BOC detector sees a change of state from a BOC Detected to a
No Valid Code seen or vice versa. The setting of this bit prompt
the user to read the RBOC register for details.
RPE
FDLS.6
Receive Packet End. Set when the HDLC controller detects
either the finish of a valid message (i.e., CRC check complete)
or when the controller has experienced a message fault such as a
CRC checking error, or an overrun condition, or an abort has
been seen. The setting of this bit prompts the user to read the
RPRM register for details.
RPS
FDLS.5
Receive Packet Start. Set when the HDLC controller detects an
opening byte. The setting of this bit prompts the user to read the
RPRM register for details.
RHALF
FDLS.4
Receive FIFO Half Full. Set when the receive 16-byte FIFO
fills beyond the halfway point. The setting of this bit prompts the
user to read the RPRM register for details.
RNE
FDLS.3
Receive FIFO Not Empty. Set when the receive 16-byte FIFO
has at least 1 byte available for a read. The setting of this bit
prompts the user to read the RPRM register for details.
THALF
FDLS.2
Transmit FIFO Half Empty. Set when the transmit 16-byte
FIFO empties beyond the halfway point. The setting of this bit
prompts the user to read the TPRM register for details.
TNF
FDLS.1
Transmit FIFO Not Full. Set when the transmit 16-byte FIFO
has at least 1 byte available. The setting of this bit prompts the
user to read the TPRM register for details.
TMEND
FDLS.0
Transmit Message End. Set when the transmit HDLC
controller has finished sending a message. The setting of this bit
prompts the user to read the TPRM register for details.
Note: The RBOC, RPE, RPS, and TMEND bits are latched and will be cleared when read.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| DS2152L-ES | 制造商:DALL 功能描述: |
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