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参数资料
| 型号： | DS2152L+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 92/97页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1CHIP ENHNCD 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 功能： | 单芯片收发器 |
| 接口： | T1 |
| 电路数： | 1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 电流 - 电源： | 75mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 管件 |
| 包括： | DSX-1 和 CSU 线路补偿发生器，HDLC 控制器，带内回路代码发生器和检测器 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS2152
92 of 97
Table 18-3. AC Characteristics—Transmit Side
(VDD = 5V ±5%, TA = 0°C to +70°C for DS2152L, TA = -40°C to +85°C for DS2152LN.)
PARAMETER
SYMBOL
MIN
TYP
MAX UNITS NOTES
TCLK Period
tCP
648
ns
tCH
75
ns
TCLK Pulse Width
tCL
75
ns
TCLKI Period
tLP
648
ns
tLH
75
ns
TCLKI Pulse Width
tLL
75
ns
tSP
122
648
ns
1
TSYSCLK Period
tSP
122
448
ns
2
tSH
50
ns
TSYSCLK Pulse Width
tSL
50
ns
TSYNC or TSSYNC Setup to TCLK or
TSYSCLK Falling
tSU
20
tCH-5
or
tSH-5
ns
TSYNC or TSSYNC Pulse Width
tPW
50
ns
TSER, TSIG, TDATA, TLINK, TPOSI,
TNEGI Setup to TCLK, TSYSCLK,
TCLKI Falling
tSU
20
ns
TSER, TSIG, TDATA, TLINK, TPOSI,
TNEGI Hold from TCLK, TSYSCLK,
TCLKI Falling
tHD
20
ns
TCLK, TCLKI, or TSYSCLK Rise and
Fall Times
tR, tF
25
ns
Delay TCLKO to TPOSO, TNEGO Valid
tDD
50
ns
Delay TCLK to TESO Valid
tD1
50
ns
Delay TCLK to TCHBLK, TCHBLK,
TSYNC, TLCLK
tD2
50
ns
Delay TSYSCLK to TCHCLK, TCHBLK
tD3
75
ns
NOTES:
1) TSYSCLK = 1.544MHz.
2) TSYSCLK = 2.048MHz.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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