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参数资料
型号： DS3134
厂商： DALLAS SEMICONDUCTOR
元件分类： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA256
封装： 27 X 27 MM, PLASTIC, BGA-256
文件页数： 135/203页
文件大小： 777K
代理商： DS3134
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页当前第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页
DS3134
37 of 203
3.8 TRANSMIT DMA REGISTERS (8XX)
Offset/
Address
Acronym
Register Name
Section
0800
TPQBA0
Transmit Pending Queue Base Address 0 (lower word).
8.2.3
0804
TPQBA1
Transmit Pending Queue Base Address 1 (upper word).
8.2.3
0808
TPQEA
Transmit Pending Queue End Address.
8.2.3
080C
TPQWP
Transmit Pending Queue Host Write Pointer.
8.2.3
0810
TPQRP
Transmit Pending Queue DMA Read Pointer.
8.2.3
0830
TDQBA0
Transmit Done Queue Base Address 0 (lower word).
8.2.4
0834
TDQBA1
Transmit Done Queue Base Address 1 (upper word).
8.2.4
0838
TDQEA
Transmit Done Queue End Address.
8.2.4
083C
TDQRP
Transmit Done Queue Host Read Pointer.
8.2.4
0840
TDQWP
Transmit Done Queue DMA Write Pointer.
8.2.4
0844
TDQFFT
Transmit Done Queue FIFO Flush Timer.
8.2.4
0850
TDBA0
Transmit Descriptor Base Address 0 (lower word).
8.2.2
0854
TDBA1
Transmit Descriptor Base Address 1 (upper word).
8.2.2
0870
TDMACIS
Transmit DMA Configuration Indirect Select.
8.2.5
0874
TDMAC
Transmit DMA Configuration.
8.2.5
0880
TDMAQ
Transmit DMA Queues Control.
8.2.3/.4
3.9 FIFO REGISTERS (9XX)
Offset/
Address
Acronym
Register Name
Section
0900
RFSBPIS
Receive FIFO Starting Block Pointer Indirect Select.
7.2
0904
RFSBP
Receive FIFO Starting Block Pointer.
7.2
0910
RFBPIS
Receive FIFO Block Pointer Indirect Select.
7.2
0914
RFBP
Receive FIFO Block Pointer.
7.2
0920
RFHWMIS
Receive FIFO High Water Mark Indirect Select.
7.2
0924
RFHWM
Receive FIFO High Water Mark.
7.2
0980
TFSBPIS
Transmit FIFO Starting Block Pointer Indirect Select.
7.2
0984
TFSBP
Transmit FIFO Starting Block Pointer.
7.2
0990
TFBPIS
Transmit FIFO Block Pointer Indirect Select.
7.2
0994
TFBP
Transmit FIFO Block Pointer.
7.2
09A0
TFLWMIS
Transmit FIFO Low Water Mark Indirect Select.
7.2
09A4
TFLWM
Transmit FIFO Low Water Mark.
7.2
3.10 PCI CONFIGURATION REGISTERS FOR FUNCTION 0 (PIDSEL/AXX)
Offset/
Address
Acronym
Register Name
Section
0x000/0A00
PVID0
PCI Vendor ID / Device ID 0.
9.2
0x004/0A04
PCMD0
PCI Command Status 0.
9.2
0x008/0A08
PRCC0
PCI Revision ID / Class Code 0.
9.2
0x00C/0A0C
PLTH0
PCI Cache Line Size / Latency Timer / Header Type 0.
9.2
0x010/0A10
PDCM
PCI Device Configuration Memory Base Address.
9.2
0x03C/0A3C
PINTL0
PCI Interrupt Line & Pin / Min. Grant / Max. Latency 0.
9.2
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