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参数资料
| 型号： | DS3134 |
| 厂商： | DALLAS SEMICONDUCTOR |
| 元件分类： | Digital Transmission Controller |
| 英文描述： | DATACOM, FRAMER, PBGA256 |
| 封装： | 27 X 27 MM, PLASTIC, BGA-256 |
| 文件页数： | 2/203页 |
| 文件大小： | 777K |
| 代理商： | DS3134 |
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DS3134
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DATA SHEET DEFINITIONS Table 1B
Acronym
Or Term
Definition
BERT
Bit Error Rate Tester.
Descriptor
A message passed back and forth between the DMA and the Host.
Dword
Double Word. A 32-bit data entity.
DMA
Direct Memory Access.
FIFO
First In First Out. Temporary memory storage scheme.
HDLC
High level Data Link Control.
Host
The main controller that resides on the PCI Bus.
n/a
Not Assigned.
V.54
A pseudorandom pattern used to control loopbacks (see ANSI T1.403)
GOVERNING SPECIFICATIONS Table 1C
ANSI (American National Standards Institute) T1.403-1995 Network-to-Customer Installation DS1
Metallic Interface March 21, 1995.
PCI Local Bus Specification V2.1 June 1, 1995.
GENERAL DESCRIPTION
The Layer One Block handles the physical input and output of serial data to and from the DS3134. The
DS3134 is capable of handling up to 64 T1 or E1 data streams or 2 T3 data streams. Each of the 16
physical ports can handle up to two or four T1 or E1 data streams. Section 14 contains some examples of
how this is performed. The Layer One Block prepares the incoming data for the HDLC Block and grooms
data from the HDLC Block for transmission. The block has the ability to perform both channelized and
unchannelized loopbacks as well as search for V.54 loop patterns. It is in the Layer One Block that the
Host will enable HDLC channels and assign them to a particular port and/or DS0 channel(s). The Host
assigns HDLC channels via the R[n]CFG[j] and T[n]CFG[j] registers, which are described in Section 5.3.
The Layer One Block interfaces directly to the Bit Error Rate Tester (BERT) Block. The BERT Block
can generate and detect both pseudorandom and repeating bit patterns and it is used to test and stress data
communication links.
The HDLC Block consists of two types of HDLC controllers. There are 16 Slow HDLC Engines (one for
each port) that are capable of operating at speeds up to 8.192 Mbps in channelized mode and up to
10 Mbps in unchannelized mode. There are also two Fast HDLC Engines, which only reside on Ports 0
and 1 and they are capable of operating at speeds up to 52 Mbps. Via the RP[n]CR and TP[n]CR
registers in the Layer One Block, the Host will configure Port 0 and 1 to use either the Slow or the Fast
HDLC engine. The HDLC Engines perform all of the Layer 2 processing which include, zero stuffing
and destuffing, flag generation and detection, CRC generation and checking, abort generation and
checking.
相关PDF资料 |
PDF描述 |
|---|---|
| DS3150QN | DATACOM, PCM TRANSCEIVER, PQCC28 |
| DS3150Q | DATACOM, PCM TRANSCEIVER, PQCC28 |
| DS3150TN | DATACOM, PCM TRANSCEIVER, PDIP48 |
| DS3150T | DATACOM, PCM TRANSCEIVER, PQFP48 |
| DS5000FP-12 | 8-BIT, 12 MHz, MICROCONTROLLER, PQFP80 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS-313PIN | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Analog Miscellaneous |
| DS-313-PIN | 功能描述:信号调节 RoHS:否 制造商:EPCOS 产品:Duplexers 频率:782 MHz, 751 MHz 频率范围: 电压额定值: 带宽: 阻抗:50 Ohms 端接类型:SMD/SMT 封装 / 箱体:2.5 mm x 2 mm 工作温度范围:- 30 C to + 85 C 封装:Reel |
| DS31400 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:8-Input, 14-Output, Dual DPLL Timing IC with Sub-ps Output Jitter |
| DS31400DK | 功能描述:时钟和定时器开发工具 DS31400 Dev Kit RoHS:否 制造商:Texas Instruments 产品:Evaluation Modules 类型:Clock Conditioners 工具用于评估:LMK04100B 频率:122.8 MHz 工作电源电压:3.3 V |
| DS31400GN | 功能描述:计时器和支持产品 Not Available From Mouser RoHS:否 制造商:Micrel 类型:Standard 封装 / 箱体:SOT-23 内部定时器数量:1 电源电压-最大:18 V 电源电压-最小:2.7 V 最大功率耗散: 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装:Reel |
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