参数资料
| 型号： | DS33ZH11+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 148/172页 |
| 文件大小： | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 7 |
| 应用： | 数据传输 |
| 接口： | 串行 |
| 电源电压： | 1.8V，2.5V，3.3V |
| 封装/外壳： | 100-LFBGA，CSPBGA |
| 供应商设备封装： | 100-CSBGA（10x10） |
| 包装： | 托盘 |
| 安装类型： | 表面贴装 |
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DS33Z11 Ethernet Mapper
77 of 172
Register Name:
GL.LIS
Register Description:
Global Serial Interface Interrupt Status
Register Address:
07h
Bit #
7
6
5
4
3
2
1
0
Name
-
LIN1TIS
-
LIN1RIS
Default
0
Bit 4: Serial Interface 1 TX Interrupt Status (LINE1TIS) This bit is set if Serial Interface 1 Transmit has an
enabled interrupt generating event. Serial Interface interrupts consist of HDLC interrupts and X.86 interrupts.
Bit 0: Serial Interface 1 RX Interrupt Status (LINER1IS) This bit is set if Serial Interface 1 Receive has an
enabled interrupt generating event. Serial Interface interrupts consist of HDLC interrupts and X.86 interrupts.
Register Name:
GL.SIE
Register Description:
Global Ethernet Interface Interrupt Enable
Register Address:
08h
Bit #
7
6
5
4
3
2
1
0
Name
-
SUB1IE
Default
0
Bit 0: Ethernet Interface 1 Interrupt Enable (SUB1IE) Setting this bit to 1 enables an interrupt on SUB1S.
Register Name:
GL.SIS
Register Description:
Global Ethernet Interface Interrupt Status
Register Address:
09h
Bit #
7
6
5
4
3
2
1
0
Name
-
SUB1IS
Default
0
Bit 0: Ethernet Interface 1 Interrupt Status (SUB1IS) This bit is set to 1 if Ethernet Interface 1 has an enabled
interrupt generating event. The Ethernet Interface consists of the MAC and The RMII/MII port.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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