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参数资料
| 型号： | E28F200B5B60 |
| 厂商： | INTEL CORP |
| 元件分类： | PROM |
| 英文描述： | DIRECTIONAL COUPLER, 20DB, SMT |
| 中文描述： | 256K X 8 FLASH 5V PROM, 70 ns, PDSO48 |
| 封装： | 12 X 20 MM, TSOP-48 |
| 文件页数： | 27/44页 |
| 文件大小： | 345K |
| 代理商： | E28F200B5B60 |
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E
28F200B5, 28F004/400B5, 28F800B5
33
PRELIMINARY
C
L
OUT
V
CC
DEVICE
UNDER
TEST
R
1
R
2
0599-12
NOTE:
CL includes jig capacitance.
Figure 13. Test Configuration
Test Configuration Component Values
Test Configuration
CL (pF) R1 (
)R2 ()
5 V Standard Test
100
580
390
5 V High-Speed Test
30
580
390
IH
V
IL
V
RP# (P)
PLPH
t
IH
V
IL
V
RP# (P)
PLPH
t
(A) Reset during Read Mode
Abort
Complete
PHQV
t
PHWL
t
PHEL
t
PHQV
t
PHWL
t
PHEL
t
(B) Reset during Program or Block Erase,
<
PLPH
t
PLRH
t
PLRH
t
IH
V
IL
V
RP# (P)
PLPH
t
Abort
Complete
PHQV
t
PHWL
t
PHEL
t
PLRH
t
Deep
Power-
Down
(C) Reset Program or Block Erase,
>
PLPH
t
PLRH
t
0599-13
Figure 14. AC Waveform for Reset Operation
Table 10. Reset Specifications(1)
Sym
Parameter
Min
Max
Unit
tPLPH
RP# Pulse Low
Time
60
ns
tPLRH
RP# Low to Reset
during Prog/Erase
12
s
1.
If RP# is tied to VCC, these specs are not applicable.
2.
These specifications are valid for all product versions
(packages and speeds).
3.
If RP# is asserted while a program or block erase, is
not executing, the reset will complete within tPLPH.
4.
A reset time, tPHQV, is required after tPLRH until outputs
are valid. See Section 3.1.5 for detailed information.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
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| E28F200BL-B150 | 制造商:INTEL 制造商全称:Intel Corporation 功能描述:2-MBIT (128K x 16, 256K x 8)LOW-POWER BOOT BLOCK FLASH MEMORY FAMILY |
| E28F200BL-T150 | 制造商:INTEL 制造商全称:Intel Corporation 功能描述:2-MBIT (128K x 16, 256K x 8)LOW-POWER BOOT BLOCK FLASH MEMORY FAMILY |
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