参数资料
型号: IS61QDB21M36-300M3
元件分类: SRAM
英文描述: 1M X 36 DDR SRAM, PBGA165
封装: 15 X 17 MM, 1 MM PITCH, LFBGA-165
文件页数: 9/27页
文件大小: 649K
代理商: IS61QDB21M36-300M3
Integrated Silicon Solution, Inc. — 1-800-379-4774
17
Rev. H
1/6/2010
36 Mb (1M x 36 & 2M x 18)
QUAD (Burst of 2) Synchronous SRAMs
Read and Deselect Cycles Timing Diagram
tCHCQX
tCHCQV
tCHCQX
tCHCQV
tCQHQX
tCQHQV
tCHQV
tCHQZ
tCHQX
tCHQV
tCHQX
tKLKH
tKHKH
tKHKL
tKHIX
tIVKH
tKHAX
tAVKH
tKHKH
tKLKH
tKHKH
tKHKL
Read
NOP
Read
NOP
A1
A2
A3
Q1-1
Q1-2
Q2-1
Q2-2
Q3-1
K
SA
R
Q (Data Out)
C
CQ
tKLKH
Notes: 1. Q1-1 refers to output from address A1+0, Q1-2 refers to output from address A1+1 (that is, the next internal
burst address following A1+0).
2. Outputs are disabled one cycle after an NOP.
Don’t Care
Undefined
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