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参数资料
| 型号： | MAX14830ETM+ |
| 厂商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SERIAL COMM CONTROLLER, QCC48 |
| 封装： | 7 X 7 MM, ROHS COMPLIANT, TQFN-48 |
| 文件页数： | 31/68页 |
| 文件大小： | 2356K |
| 代理商： | MAX14830ETM+ |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页
MAX14830
Quad Serial UART with 128-Word FIFOs
and Internal Oscillator
37
STSIntEn—STS Interrupt Enable Register
Bits 7, 6: No Function
Bit 5: ClkRdyIntEn
Set the ClkRdyIntEn bit high to route the ClockReady status bit to the ISR[2]: STSInt bit. If set low, the STSIntEn[5]
masks the ISR[2] bit from the ClockReady status.
Bit 4: No Function
Bits 3–0: GPI[n]IntEn
Each UART has four individually assigned GPIO outputs as follows: UART0: GPIO0–GPIO3, UART1: GPIO4–GPIO7,
UART2: GPIO8–GPIO11, UART3: GPIO12–GPIO15. For example, for UART0: Bit 0 is GPI0IntEn, Bit 1 is GPI1IntEn, Bit
2 is GPI2IntEn, and Bit 3 is GPI3IntEn. See Table 1.
The GPI[n]IntEn bits that are set high route the associated STSInt[3:0]: GPI[n]Int bits to the ISR[2] interrupt. GPI[n]IntEn
bits that are set low, mask the ISR[2] interrupt from the associated GPI[n]Int bit.
ADDRESS:
0x07
MODE:
R/W
BIT
7
6
5
4
3
2
1
0
NAME
—
ClockRdyIntEn
—
GPI3IntEn
GPI2IntEn
GPI1IntEn
GPI0IntEn
RESET
0
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PDF描述 |
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参数描述 |
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