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参数资料
| 型号： | MCF5235CVM100 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 15/76页 |
| 文件大小： | 2665K |
| 代理商： | MCF5235CVM100 |
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22
MCF523x Integrated Microprocessor Hardware Specifications
MOTOROLA
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Signal Primary Functions
2.2.5
SDRAM Controller Signals
Table 7 describes signals that are used for SDRAM accesses.
2.2.6
External Interrupt Signals
Table 8 describes the external interrupt signals.
2.2.7
eTPU
Table 9 describes eTPU signals.
Table 7. SDRAM Controller Signals
Signal Name
Abbreviation
Function
I/O
SDRAM Synchronous
Row Address Strobe
SD_SRAS
SDRAM synchronous row address strobe.
This pin is configured as GPIO.
O
SDRAM Synchronous
Column Address Strobe
SD_SCAS
SDRAM synchronous column address strobe.
This pin is configured as GPIO.
O
SDRAM Write Enable
SD_WE
SDRAM write enable.
This pin is configured as GPIO.
O
SDRAM Chip Selects
SD_CS[1:0]
SDRAM chip select signals.
These pints are configured as GPIO.
O
SDRAM Clock Enable
SD_CKE
SDRAM clock enable.
This pin is configured as GPIO.
O
Table 8. External Interrupt Signals
Signal Name
Abbreviation
Function
I/O
External Interrupts
IRQ[7:1]
External interrupt sources. IRQ2 can also be configured as DMA
request signal DREQ2.
These pins are configured as GPIO.
I
Table 9. eTPU Signals
Signal Name
Abbreviation
Function
I/O
TCRCLK
Used to clock the TCR1/2 counters or gate the TCR2 clock.
I
TPUCH[31:0]
TPUCH[31:0] Channel pins for the eTPU module. They can also be configured for
Ethernet controller functionality. See table Table 2 and Section 2.2.8,
“Ethernet Module (FEC) Signals,” for details.
I/O
LTPUODIS
Disables eTPU outputs on the lower 16 channels of the eTPU.
I/O
UTPUDIS
Disables eTPU outputs on the upper 16 channels of the eTPU.
I/O
相关PDF资料 |
PDF描述 |
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参数描述 |
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