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参数资料
| 型号： | MCF5235CVM100 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 24/76页 |
| 文件大小： | 2665K |
| 代理商： | MCF5235CVM100 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页当前第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页
30
MCF523x Integrated Microprocessor Hardware Specifications
MOTOROLA
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Chip Configuration Mode—Device Operating Options
Clock mode:
— Normal PLL with external crystal
— Normal PLL with external clock
— 1:1 PLL Mode
— External oscillator mode (no PLL)
Chip Select Configuration:
— PADDR[7:5] configured as chip select(s) and/or address line(s)
– PADDR[7:5] configured as A23-A21 (default)
– PADDR configured as CS6, PADDR[6:5] as A22-A21
– PADDR[7:6] configured as CS[6:5], PADDR5 as A21
– PADDR[7:5] configured as CS[6:4]
3.1.1
Chip Configuration Pins
Table 19. Configuration Pin Descriptions
Pin
Chip Configuration
Function
Pin State/Meaning
Comments
RCON
Chip configuration
enable
1Disabled
0 Enabled
Active low: if asserted, then all
configuration pins must be driven
appropriately for desired operation
D26, D17, D16
Select chip
operating mode
111 Master
110 Reserved
101 Reserved
100 Reserved
0xx Reserved
D19, D18
Select external boot
device data port size
00,11 External (32-bit)
10 External (8-bit)
01 External (16-bit)
Value read defaults to 32-bit
D21
Select output pad
drive strength
1Full
0 Partial
CLKMOD1,
CLKMOD0
Select clock mode
00 External clock mode (no
PLL)
01 1:1 PLL mode
10 Normal PLL with external
clock reference
11 Normal PLL with crystal
clock reference
VDDPLL must be supplied if a PLL
mode is selected
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