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参数资料
| 型号： | MCF5235CVM100 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 29/76页 |
| 文件大小： | 2665K |
| 代理商： | MCF5235CVM100 |
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MOTOROLA
MCF523x Integrated Microprocessor Hardware Specifications
35
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Interface Recommendations
The following tables provide a more comprehensive, step-by-step way to determine the correct address line
connections for interfacing the MCF523x to SDRAM. To use the tables, find the one that corresponds to the
number of column address lines on the SDRAM and to the port size as seen by the MCF523x, which is not
necessarily the SDRAM port size. For example, if two 1M x 16-bit SDRAMs together form a 2M x 32-bit
memory, the port size is 32 bits. Most SDRAMs likely have fewer address lines than are shown in the tables,
so follow only the connections shown until all SDRAM address lines are connected.
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Table 22. MCF523x to SDRAM Interface (8-Bit Port, 9-Column Address Lines)
MCF523x
Pins
A17 A16 A15 A14 A13 A12 A11 A10 A9 A18 A19 A20 A21 A22 A23 A24 A25 A26 A27 A28 A29 A30 A31
Row
17
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Column
0
1
2
3
4
5
6
7
8
SDRAM
Pins
A0 A1 A2 A3 A4 A5 A6 A7 A8 A9 A10 A11 A12 A13 A14 A15 A16 A17 A18 A19 A20 A21 A22
Table 23. MCF523x to SDRAM Interface (8-Bit Port,10-Column Address Lines)
MCF523x
Pins
A17 A16 A15 A14 A13 A12 A11 A10 A9 A19 A20 A21 A22 A23 A24 A25 A26 A27 A28 A29 A30 A31
Row
17
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13
12
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10
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Column
0
1
2
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6
7
8
18
SDRAM
Pins
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9 A10 A11 A12 A13 A14 A15 A16 A17 A18 A19 A20 A21
Table 24. MCF523x to SDRAM Interface (8-Bit Port,11-Column Address Lines)
MCF523x
Pins
A17 A16 A15 A14 A13 A12 A11 A10 A9 A19 A21 A22 A23 A24 A25 A26 A27 A28 A29 A30 A31
Row
17
16
15
14
13
12
11
10
9
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Column
0
1
2
3
4
5
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SDRAM
Pins
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9 A10 A11 A12 A13 A14 A15 A16 A17 A18 A19 A20
Table 21. Generic Address Multiplexing Scheme (continued)
Address Pin Row Address Column Address
Notes Related to Port Sizes
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