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参数资料
| 型号： | MCF5235CVM100 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | MAPBGA-256 |
| 文件页数： | 58/76页 |
| 文件大小： | 2665K |
| 代理商： | MCF5235CVM100 |
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MOTOROLA
MCF523x Integrated Microprocessor Hardware Specifications
61
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Processor Bus Output Timing Specifications
Figure 14 shows an SDRAM read cycle.
Figure 14. SDRAM Read Cycle
Table 48. SDRAM Timing
NUM
Characteristic
Symbol
Min
Max
Unit
D1
CLKOUT high to SDRAM address valid
tCHDAV
—
9
ns
D2
CLKOUT high to SDRAM control valid
tCHDCV
—
9
ns
D3
CLKOUT high to SDRAM address invalid
tCHDAI
1.5
—
ns
D4
CLKOUT high to SDRAM control invalid
tCHDCI
1.5
—
ns
D5
SDRAM data valid to CLKOUT high
tDDVCH
4
—
ns
D6
CLKOUT high to SDRAM data invalid
tCHDDI
1.5
—
ns
D7 1
1
D7 and D8 are for write cycles only.
CLKOUT high to SDRAM data valid
tCHDDVW
—
9
ns
D82
CLKOUT high to SDRAM data invalid
tCHDDIW
1.5
—
ns
A[23:0]
RAS
D[31:0]
ACTV
NOP
PALL
NOP
RAS[1:0[
READ
Column
SD_CKE
0
SDWE
CAS[3:0]
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
D1
D2
D4
D6
D5
D4
1 DACR[CASL] = 2
CAS 1
NOP
D4
Row
D3
D2
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PDF描述 |
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