参数资料
| 型号： | MCIMX258CJM4 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 96/153页 |
| 文件大小： | 0K |
| 描述： | MPU IMX25 IND 400-MAPBGA |
| 特色产品： | MCIMX25 Applications Processors |
| 标准包装： | 90 |
| 系列： | i.MX25 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 400MHz |
| 连通性： | 1 线，CAN，EBI/EMI，以太网，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 128 |
| 程序存储器类型： | 外部程序存储器 |
| RAM 容量： | 144K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.15 V ~ 1.52 V |
| 数据转换器： | A/D 3x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 400-LFBGA |
| 包装： | 托盘 |
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i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
Freescale Semiconductor
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To meet timing requirements, a number of timing parameters must be controlled. See Table 38 for details
on timing parameters for MDMA read and write modes.
3.7.2.3
Ultra DMA (UDMA) Mode Timing
UDMA mode timing is more complicated than PIO mode or MDMA mode. In this section, timing
diagrams for UDMA in- and out-transfers are provided.
Table 38. Timing Parameters for MDMA Read and Write Modes
ATA
Parameter
MDMA Read1
and Write2
Timing
Parameters
1 See Figure 13.
2 See Figure 14.
Relation
Adjustable
Parameter(s)
tm, ti
tm
tm(min.) = ti(min.) = time_m
× T – (tskew1 + tskew2 + tskew5)
time_m
td
td, td1
td1(min.) = td(min.) = time_d
× T – (tskew1 + tskew2 + tskew6)
time_d
tk
tk(min.) = time_k
× T – (tskew1 + tskew2 + tskew6)
time_k
t0
—
t0(min.) = (time_d + time_k)
× T
time_d, time_k
tg(read)
tgr
tgr(min.–read) = tco + tsu + tbuf + tbuf + tcable1 + tcable2
tgr(min.–drive) = td – te(drive)
time_d
tf(read)
tfr
tfr(min.–drive) =0 k
—
tg(write)
—
tg(min.–write) = time_d
× T –(tskew1 + tskew2 + tskew5)
time_d
tf(write)
—
tf(min.–write) = time_k
× T – (tskew1 + tskew2 + tskew6)
time_k
tL
—
tL(max.) = (time_d + time_k–2)
× T – (tsu + tco + 2 × tbuf + 2 × tcable2)
time_d, time_k3
3 tk1 in the UDMA figures equals (tk –2 × T).
tn, tj
tkjn
tn= tj= tkjn = (max.(time_k,. time_jn)
× T – (tskew1 + tskew2 + tskew6)
time_jn
—ton
toff
ton = time_on
× T – tskew1
toff = time_off
× T – tskew1
—
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