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参数资料
| 型号： | MPC8313E-RDB |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 14/99页 |
| 文件大小： | 0K |
| 描述： | BOARD PROCESSOR |
| 产品培训模块： | MPC8313E PowerQUICC Processor MPC8314/15 Product Overview |
| 标准包装： | 1 |
| 系列： | PowerQUICC II™ PRO |
| 类型： | MCU |
| 适用于相关产品： | MPC8313E |
| 所含物品： | 参考设计板、软件和说明文档 |
| 相关产品： | MPC8313VRAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313EZQAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313EVRAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313ECZQAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313ECVRAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313CZQAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313CVRAFFB-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313ZQAFF-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313ZQADD-ND - IC MPU POWERQUICC II PRO 516PBGA MPC8313VRAFF-ND - IC MPU POWERQUICC II PRO 516PBGA 更多... |
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MPC8313E PowerQUICC II Pro Processor Hardware Specifications, Rev. 4
Freescale Semiconductor
21
This figure provides the AC test load for the DDR bus.
Figure 7. DDR AC Test Load
7DUART
This section describes the DC and AC electrical specifications for the DUART interface.
7.1
DUART DC Electrical Characteristics
This table provides the DC electrical characteristics for the DUART interface.
7.2
DUART AC Electrical Specifications
This table provides the AC timing parameters for the DUART interface.
8
Ethernet: Three-Speed Ethernet, MII Management
This section provides the AC and DC electrical characteristics for three-speed, 10/100/1000, and MII
management.
Table 22. DUART DC Electrical Characteristics
Parameter
Symbol
Min
Max
Unit
High-level input voltage
VIH
2.0
NVDD + 0.3
V
Low-level input voltage NVDD
VIL
–0.3
0.8
V
High-level output voltage, IOH = –100 AVOH
NVDD – 0.2
—
V
Low-level output voltage, IOL = 100 AVOL
—0.2
V
Input current (0 V
V
IN NVDD)IIN
—±5
A
Table 23. DUART AC Timing Specifications
Parameter
Value
Unit
Note
Minimum baud rate
256
baud
—
Maximum baud rate
> 1,000,000
baud
1
Oversample rate
16
—
2
Notes:
1. Actual attainable baud rate is limited by the latency of interrupt processing.
2. The middle of a start bit is detected as the 8th sampled 0 after the 1-to-0 transition of the start bit. Subsequent bit values are
sampled each 16th sample.
Output
Z0 = 50
GVDD/2
RL = 50
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参数描述 |
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