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参数资料
| 型号： | MSC8144ADS |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 52/80页 |
| 文件大小： | 0K |
| 描述： | ADS FOR MSC8144 DEVICE |
| 标准包装： | 1 |
| 类型： | DSP |
| 适用于相关产品： | MSC8144 |
| 所含物品： | AMC 卡、电源、缆线、USB TAP、硬件和说明文档 |
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Electrical Characteristics
2.6.7
TDM Timing
Table 37. TDM Timing
Characteristic
TDMxRCLK/TDMxTCLK
TDMxRCLK/TDMxTCLK high pulse width
TDMxRCLK/TDMxTCLK low pulse width
TDM receive all input setup time related to TDMxRCLK
Symbol
t TDMC
t TDMCH
t TDMCL
t TDMVKH
Expression
TC 1
(0.5 ± 0.1) × TC 4
(0.5 ± 0.1) × TC 4
Min
16
7
7
3.6
Max
—
—
—
—
Units
ns
ns
ns
ns
TDMxTSYN input setup time related to TDMxTCLK in TSO=0 mode
TDM receive all input hold time related to TDMxRCLK
t TDMXKH
1.9
—
ns
TDMxTSYN input hold time related to TDMxTCLK in TSO=0 mode
TDMxTCLK high to TDMxTDAT output active 2
TDMxTCLK high to TDMxTDAT output valid 2
All output hold time (except TDMxTSYN) 3
TDMxTCLK high to TDMxTDAT output high impedance 2
TDMxTCLK high to TDMxTSYN output valid 2
TDMxTSYN output hold time 3
t TDMDHOX
t TDMDHOV
t TDMHOX
t TDMDHOZ
t TDMSHOV
t TDMSHOX
2.5
—
2.5
—
—
2.0
—
9.8
—
9.8
9.25
—
ns
ns
ns
ns
ns
ns
Notes:
1.
2.
3.
4.
Values are based on a a maximum frequency of 62.5 MHz. The TDM interface supports any frequency below 62.5 MHz.
Values are based on 20 pF capacitive load.
Values are based on 10 pF capacitive load.
The expression is for common calculations only.
Figure 18 shows the TDM input AC timing.
t TDMC
TDMxRCLK
t TDMVKH
TDMxRDAT
t TDMCH
t TDMXKH
t TDMCL
t TDMVKH
t TDMXKH
TDMxRSYN
Figure 18. TDM Inputs Signals
Note:
For some TDM modes, receive data and receive sync are input on other pins. This timing is also valid for them. See
the MSC8144 Reference Manual .
TDMxTCLK
t TDMVKH
t TDMXKH
TDMxTSYN
Figure 19. TDMxTSYN in TSO=0 mode
Figure 20 shows the TDM Output AC timing
MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
52
Freescale Semiconductor
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