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参数资料
| 型号： | OR4E063BA352-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 2024 CLBS, 515000 GATES, PBGA352 |
| 封装： | PLASTIC, BGA-352 |
| 文件页数： | 147/151页 |
| 文件大小： | 2680K |
| 代理商： | OR4E063BA352-DB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页当前第147页第148页第149页第150页第151页
Lattice Semiconductor
95
Data Sheet
September, 2002
ORCA Series 4 FPGAs
TimingCharacteristics(continued)
Table61.MasterSerialConfigurationModeTimingCharacteristics
OR4ExxxIndustrial:VDD15=1.4Vto1.6V,VDD33=3.0Vto3.6V,VDDIO=3.0Vto3.6V,–40°C
<TJ
<+125°C;CL= 30pF.
Note:SerialconfigurationdataistransmittedoutonDOUTontherisingedgeofCCLKafteritisinputonDIN.
* DatagetsclockedoutfromanexternalserialROM.TheclocktodatadelayoftheserialROMmustbelessthantheCCLKfrequencysince
thedataavailableoutoftheserialROMmustbesetupandwaitingtobeclockedintotheFPGAbeforethenextCCLKrisingedge.
5-4532(F).b
Figure54.MasterSerialConfigurationModeTimingDiagram
Parameter
Symbol
Min
Max
Unit
DINSetupTime*
TS
10.00
—
ns
DINHoldTime
TH
0.00
—
ns
CCLKFrequency(M3=0)
FC
5.00
16.67
MHz
CCLKFrequency(M3=1)
FC
0.63
2.08
MHz
CCLKtoDOUTDelay
TD
—
5.00
ns
DIN
CCLK
DOUT
TS
TH
BIT N
TD
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