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参数资料
| 型号： | OR4E063BA352-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 2024 CLBS, 515000 GATES, PBGA352 |
| 封装： | PLASTIC, BGA-352 |
| 文件页数： | 148/151页 |
| 文件大小： | 2680K |
| 代理商： | OR4E063BA352-DB |
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96
Lattice Semiconductor
Data Sheet
September, 2002
ORCA Series 4 FPGAs
TimingCharacteristics(continued)
Table62.MasterParallelConfigurationModeTimingCharacteristics
OR4ExxxIndustrial:VDD15=1.4Vto1.6V,VDD33=3.0Vto3.6V,VDDIO=3.0Vto3.6V,–40°C
<TJ<+125°C;
CL= 30pF.
Note:
TheRCLKperiodconsistsofsevenCCLKsforRCLKlowandoneCCLKforRCLKhigh.
SerialdataistransmittedoutonDOUTtwoCCLKcyclesafterthebyteisinputonD[7:0].
2706(F)
Figure55.MasterParallelConfigurationModeTimingDiagram
Parameter
Symbol
Min
Max
Unit
RCLKtoAddressValid
TAV
—
10.00
ns
D[7:0]SetupTimetoRCLKHigh
TS
10.00
—
ns
D[7:0]HoldTimetoRCLKHigh
TH
0.00
—
ns
RCLKLowTime
TCL
7.00
CCLKcycles
RCLKHighTime
TCH
1.00
CCLKcycles
CCLKtoDOUT
TD
—
5.00
ns
A[21:0]
RCLK
D[7:0]
TCL
TCH
TAV
CCLK
DOUT
TH
TS
BYTEN
BYTEN+1
D0
D1
D2
D3
D4
D5
D6
D7
TD
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PDF描述 |
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