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参数资料
| 型号： | OR4E063BA352-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 2024 CLBS, 515000 GATES, PBGA352 |
| 封装： | PLASTIC, BGA-352 |
| 文件页数： | 74/151页 |
| 文件大小： | 2680K |
| 代理商： | OR4E063BA352-DB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页
Lattice Semiconductor
29
Data Sheet
September, 2002
ORCA Series 4 FPGAs
Embedded Block RAM (continued)
0308(F)
Figure 21. EBR Read and Write Cycles with Write Through and Nonregistered Read Port
Table 9. FIFO Signals
Port Signals
I/O
Function
AR0[5:0]
I
Programs FIFO ags. Used for partially empty ag size.
AR1[9:0]
I
Programs FIFO ags. Used for partially full ag size.
FF
O
Full Flag.
PFF
O
Partially Full Flag.
PEF
O
Partially Empty Flag.
EF
O
Empty Flag.
D0[17:0]
I
Data inputs for all congurations.
D1[17:0]
I
Data inputs for 256x36 congurations only.
CKW[0:1]
I
Positive-edge write port clock. Port 1 only used for 256x36 congurations.
CKR[0:1]
I
Positive-edge read port clock. Port 1 only used for 256x36 congurations.
CSW[1:0]
I
Active-high write enable. Port 1 only used for 256x36 congurations.
CSR[1:0]
I
Active-high read enable. Port 1 only used for 256x36 congurations.
RESET
I
Active-low Resets FIFO pointers.
Q0[17:0]
O
Data outputs for all congurations.
Q1[17:0]
O
Data outputs for 256x36 congurations.
CKWPH
CKWPL
CSWSU
CSWH
AWH
DSU
DH
BWSU
BWH
AWSU
CKWQ
AQ
AQH
ab
c
d
bc
a
d
c
CKW
CSW
AW
D
BW
AR
Q
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