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参数资料
| 型号： | PH28F640L18T85 |
| 厂商： | INTEL CORP |
| 元件分类： | PROM |
| 英文描述： | StrataFlash Wireless Memory |
| 中文描述： | 4M X 16 FLASH 1.8V PROM, 85 ns, PBGA56 |
| 封装： | 0.75 MM PITCH, LEAD FREE, VFBGA-56 |
| 文件页数： | 33/106页 |
| 文件大小： | 1272K |
| 代理商： | PH28F640L18T85 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页
Intel StrataFlash Wireless Memory (L18)
Datasheet
Intel StrataFlash Wireless Memory (L18)
Order Number: 251902, Revision: 009
April 2005
33
Note:
WAIT shown deasserted during asynchronous read mode (RCR[10]=0 Wait asserted low).
R311
R312
t
CHVL
t
CHTX
CLK Valid to ADV# Setup
WAIT Hold from CLK
0
3
-
-
ns
ns
1
1,5
NOTES:
1.
See
Figure 8, “AC Input/Output Reference Waveform” on page 28
for timing measurements and max allowable input slew
rate.
OE# may be delayed by up to t
ELQV
– t
GLQV
after CE#’s falling edge without impact to t
ELQV
.
Sampled, not 100% tested.
Address hold in synchronous burst mode is t
or t
VHAX
, whichever timing specification is satisfied first.
Applies only to subsequent synchronous reads.
The specifications in
Section 7.3
will
only
be used by customers (1) who desire a 1.35 to 2.0 V
operating range OR
(2) who desire to transition their host controller from a 1.7 V to 2.0 V V
CCQ
voltage now to a lower range in the future.
2.
3.
4.
5.
6.
Num
Symbol
Parameter
Speed
–85
Units
Notes
Min
Max
Figure 11.
Asynchronous Single-Word Read with ADV# Low
R5
R7
R6
R17
R15
R9
R4
R8
R3
R1
R2
Address [A]
ADV#
CE# [E}
OE# [G]
WAIT [T]
Data [D/Q]
RST# [P]
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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