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参数资料
| 型号： | PH28F640L18T85 |
| 厂商： | INTEL CORP |
| 元件分类： | PROM |
| 英文描述： | StrataFlash Wireless Memory |
| 中文描述： | 4M X 16 FLASH 1.8V PROM, 85 ns, PBGA56 |
| 封装： | 0.75 MM PITCH, LEAD FREE, VFBGA-56 |
| 文件页数： | 36/106页 |
| 文件大小： | 1272K |
| 代理商： | PH28F640L18T85 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页当前第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页
Intel StrataFlash Wireless Memory (L18)
April 2005
36
Intel StrataFlash Wireless Memory (L18)
Order Number: 251902, Revision: 009
Datasheet
Note:
WAIT is driven per OE# assertion during synchronous array or non-array read. WAIT asserted during
initial latency and deasserted during valid data (RCR[10] = 0 Wait asserted low).
Notes:
1.
2.
CLK can be stopped in either high or low state.
WAIT is driven per OE# assertion during synchronous array or non-array read. WAIT asserted during
initial latency and deasserted during valid data (RCR[10] = 0 Wait asserted low).
Figure 16.
Synchronous Burst-Mode Four-Word Read Timing
Latency Count
A
Q0
Q1
Q2
Q3
R307
R10
R304
R305
R304
R4
R7
R17
R15
R9
R8
R303
R3
R106
R102
R105
R101
R2
R306
R302
R301
CLK [C]
Address [A]
ADV# [V]
CE# [E]
OE# [G]
WAIT [T]
Data [D/Q]
Figure 17.
Burst Suspend Timing
Q0
Q1
Q1
Q2
R15
R17
R304
R304
R7
R6
R312
R15
R4
R9
R4
R3
R106
R101
R105
R1
R2
R305
R305
R304
CLK
Address [A]
ADV#
CE# [E]
OE# [G]
WAIT [T]
WE# [W]
DATA [D/Q]
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PDF描述 |
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参数描述 |
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