参数资料
型号: PIC18F45J50-I/ML
厂商: Microchip Technology
文件页数: 28/164页
文件大小: 0K
描述: IC PIC MCU FLASH 32K 2V 44-QFN
产品培训模块: XLP Deep Sleep Mode
PIC18 J Series MCU Overview
8-bit PIC® Microcontroller Portfolio
标准包装: 45
系列: PIC® XLP™ 18F
核心处理器: PIC
芯体尺寸: 8-位
速度: 48MHz
连通性: I²C,SPI,UART/USART,USB
外围设备: 欠压检测/复位,DMA,POR,PWM,WDT
输入/输出数: 34
程序存储器容量: 32KB(16K x 16)
程序存储器类型: 闪存
RAM 容量: 3.8K x 8
电压 - 电源 (Vcc/Vdd): 2.15 V ~ 3.6 V
数据转换器: A/D 13x10b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 44-VQFN 裸露焊盘
包装: 管件
产品目录页面: 657 (CN2011-ZH PDF)
配用: AC164322-ND - MODULE SOCKET MPLAB PM3 28/44QFN
2011 Microchip Technology Inc.
DS39931D-page 123
PIC18F46J50 FAMILY
9.3
PIE Registers
The PIE registers contain the individual enable bits for
the peripheral interrupts. Due to the number of
peripheral interrupt sources, there are three Peripheral
Interrupt Enable registers (PIE1, PIE2, PIE3). When
IPEN = 0, the PEIE bit must be set to enable any of
these peripheral interrupts.
REGISTER 9-7:
PIE1: PERIPHERAL INTERRUPT ENABLE REGISTER 1 (ACCESS F9Dh)
R/W-0
PMPIE(1)
ADIE
RC1IE
TX1IE
SSP1IE
CCP1IE
TMR2IE
TMR1IE
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
PMPIE:
Parallel Master Port Read/Write Interrupt Enable bit(1)
1
= Enables the PMP read/write interrupt
0
= Disables the PMP read/write interrupt
bit 6
ADIE:
A/D Converter Interrupt Enable bit
1
= Enables the A/D interrupt
0
= Disables the A/D interrupt
bit 5
RC1IE:
EUSART1 Receive Interrupt Enable bit
1
= Enables the EUSART1 receive interrupt
0
= Disables the EUSART1 receive interrupt
bit 4
TX1IE:
EUSART1 Transmit Interrupt Enable bit
1
= Enables the EUSART1 transmit interrupt
0
= Disables the EUSART1 transmit interrupt
bit 3
SSP1IE:
Master Synchronous Serial Port 1 Interrupt Enable bit
1
= Enables the MSSP1 interrupt
0
= Disables the MSSP1 interrupt
bit 2
CCP1IE:
ECCP1 Interrupt Enable bit
1
= Enables the ECCP1 interrupt
0
= Disables the ECCP1 interrupt
bit 1
TMR2IE:
TMR2 to PR2 Match Interrupt Enable bit
1
= Enables the TMR2 to PR2 match interrupt
0
= Disables the TMR2 to PR2 match interrupt
bit 0
TMR1IE:
TMR1 Overflow Interrupt Enable bit
1
= Enables the TMR1 overflow interrupt
0
= Disables the TMR1 overflow interrupt
Note 1:
These bits are unimplemented on 28-pin devices.
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