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参数资料
| 型号： | PM73121-RI |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP240 |
| 封装： | QFP-240 |
| 文件页数： | 90/223页 |
| 文件大小： | 2300K |
| 代理商： | PM73121-RI |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页当前第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页
PM73121AAL1gator II
PMC-Sierra, Inc.
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
The AAL1gator II provides the receive buffer frame difference for an external circuit to generate
an adaptive TL_CLK signal. The general mechanism is often termed “buffer centering”. A clock
delta value is determined externally by subtracting the nominal frame difference (value of R_
CDVT) from the actual receive buffer frame difference. This delta value is then transformed into
the frequency selection for an external TL_CLK frequency synthesizer.
The closed-loop action of
this circuit causes the delta value to find a center point. When the delta is above the center point,
there is too much data buffered and the TL_CLK frequency must be increased. When the delta is
below the center point, there is too little data buffered and the TL_CLK frequency must be
decreased.
As mentioned in the ATM Forum CES Standard Specification (refer to
Appendix B, “Refer-
ences”, on page 203
), the adaptive clock recovery algorithm does not meet the T1/E1 clock wan-
der requirements. See Figure 52, which shows a direct adaptive clocking implementation.
3
0
0
frame_diff(8)
frame_diff(7)
2
frame_diff(6)
frame_diff(5)
frame_diff(4)
frame_diff(3)
1
frame_diff(2)
frame_diff(1)
frame_diff(0)
0
0
0
0
0
0
NOTES:
The 9-bit frame_diff value gives the number of frames currently stored in the rx frame buffer.
For UDF-ML mode, frame_diff is expressed in 256-bit increments.
The cell_vci(7:5) identifies the eight line numbers.
The cell_vci(4:0) bits can be ignored in UDF-ML mode.
The frame difference values for each queue are played out in sequence 5 to 0 every time a
cell is received and a valid frame difference can be calculated.
Table 4.
Frame Difference (Continued)
SRTS_LINE(3:0)
Value
SRTS_DOUT(3:0) Value
3
2
1
0
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