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参数资料
| 型号： | PM73121-RI |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP240 |
| 封装： | QFP-240 |
| 文件页数： | 91/223页 |
| 文件大小： | 2300K |
| 代理商： | PM73121-RI |
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PM73121AAL1gator II
PMC-Sierra, Inc.
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
Adaptive clocking, in general, is not well-suited for voice applications since low frequency or DC
changes of the CDV will pass through most filters and cause frame slips. The mechanism shown
in Figure 52 can be enhanced for voice applications by adding a low pass filter with a time con-
stant greater than the CDV, along with a fine-granularity frequency synthesizer.
3.8
The MIAC is the central arbiter for all memory accesses. It provides a priority mechanism that
incorporates fairness to satisfy all real-time requirements of the various blocks. All blocks
requesting a data transfer with the common memory supply the address, control signals, and the
data, if the requested data transfer is a write, to the MIAC. When the MIAC actually grants the
transfer, it provides a grant signal to the requesting block, indicating that the transfer has been
performed. The memory is arbitrated on a cycle-by-cycle basis. No device is granted the bus for
an indefinite time.
Memory Interface and Arbitration Controller (MIAC)
The AAL1gator II requires external memory address buffers and data transceivers. The MIAC
provides control signals and transceiver enables when a microprocessor cycle is to be performed.
The device can directly control external 646-type registered transceivers on the data bus between
the memory data interface and the microprocessor’s data bus. The SP_DATA_CLK signal con-
trols the writing of data from the memory into the 646 transceiver. The SP_DATA_DIR signal
and SP_DATA_EN signal should be used to direct the data through the 646s devices properly.
with the microprocessor external buffers.
Figure 52.
Direct Adaptive Clock Operation
Channel Status
AAL1 SAR Processor
(AAL1gator II)
TL_CLK
TL_SER
TL_SIG
Framer
Line Interface
with Transmit
Jitter Attenuator
Gain
Frequency
Synthesizer
Use Nominal
Frequency
Frame
Difference
Nominal Frame Difference
Underrun
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PDF描述 |
|---|---|
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PM73122 | 制造商:PMC 制造商全称:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全称:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
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