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参数资料
型号： S1C17651B00E10M
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
文件页数： 45/216页
文件大小： 1784K
代理商： S1C17651B00E10M
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16 SPI
S1C17651 TECHNICAL MANUAL
Seiko Epson Corporation
16-7
SPI Ch.x Transmit Data Register (SPI_TXDx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
SPI Ch.x
Transmit Data
Register
(SPI_TXDx)
0x4322
(16 bits)
D15–8 –
reserved
–
0 when being read.
D7–0 SPTDB[7:0] SPI transmit data buffer
SPTDB7 = MSB
SPTDB0 = LSB
0x0 to 0xff
0x0 R/W
D[15:8]
Reserved
D[7:0]
SPTDB[7:0]: SPI Transmit Data Buffer Bits
Sets transmit data to be written to the transmit data buffer. (Default: 0x0)
In master mode, transmission is started by writing data to this register. In slave mode, the contents of
this register are sent to the shift register and transmission begins when the clock is input from the mas-
ter.
SPTBE/SPI_STx register is set to 1 (empty) as soon as data written to this register has been transferred
to the shift register. A transmit buffer empty interrupt is generated at the same time. The subsequent
transmit data can then be written, even while data is being transmitted.
Serial converted data is output from the SDOx pin, with the bit set to 1 as High level and the bit set to 0
as Low level.
Note: Make sure that SPEN is set to 1 before writing data to the SPI_TXDx register to start data trans-
mission/reception.
SPI Ch.x Receive Data Register (SPI_RXDx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
SPI Ch.x
Receive Data
Register
(SPI_RXDx)
0x4324
(16 bits)
D15–8 –
reserved
–
0 when being read.
D7–0 SPRDB[7:0] SPI receive data buffer
SPRDB7 = MSB
SPRDB0 = LSB
0x0 to 0xff
0x0
R
D[15:8]
Reserved
D[7:0]
SPRDB[7:0]: SPI Receive Data Buffer Bits
Contains the received data. (Default: 0x0)
SPRBF/SPI_STx register is set to 1 (data full) as soon as data is received and the shift register data has
been transferred to the receive data buffer. A receive buffer full interrupt is generated at the same time.
Data can then be read until subsequent data is received. If receiving the subsequent data is completed
before the register has been read out, the new received data overwrites the contents.
Serial data input from the SDIx pin is converted to parallel, with the High level bit set to 1 and the Low
level bit set to 0. The data is the loaded into this register.
This register is read-only.
SPI Ch.x Control Register (SPI_CTLx)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
SPI Ch.x Con-
trol Register
(SPI_CTLx)
0x4326
(16 bits)
D15–10 –
reserved
–
0 when being read.
D9
MCLK
SPI clock source select
1 T8 Ch.0
0 PCLK/4
0
R/W
D8
MLSB
LSB/MSB first mode select
1 LSB
0 MSB
0
R/W
D7–6 –
reserved
–
0 when being read.
D5
SPRIE
Receive data buffer full int. enable 1 Enable
0 Disable
0
R/W
D4
SPTIE
Transmit data buffer empty int. enable 1 Enable
0 Disable
0
R/W
D3
CPHA
Clock phase select
1 Data out
0 Data in
0
R/W These bits must be
set before setting
SPEN to 1.
D2
CPOL
Clock polarity select
1 Active L
0 Active H
0
R/W
D1
MSSL
Master/slave mode select
1 Master
0 Slave
0
R/W
D0
SPEN
SPI enable
1 Enable
0 Disable
0
R/W
Note: Do not access to the SPI_CTLx register while SPBSY/SPI_STx register is set to 1 or SPRBF/
SPI_STx register is set to 1 (while data is being transmitted/received).
D[15:10] Reserved
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