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参数资料
| 型号： | S1R72803F00A100 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | 0.40 MM PITCH, PLASTIC, QFP20-184 |
| 文件页数： | 78/115页 |
| 文件大小： | 833K |
| 代理商： | S1R72803F00A100 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页当前第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页
S1R72803F00A
EPSON
61
Address Register Name
Bit Symbol
R/W
Description
H.Rst S.Rst B.Rst
0x31
SBP2Stat
7: FwPause
R
0: Not Firmware Pause
1: FirmWre Pause
6: ErrPause
R
0: Not Error Pause
1: Error Pause
5: NotQuadEnable
R/W
0: Disable
1: Enable
4: WaitPLReady
R
0: Not Ready
1: Ready
0x00
–
3: HwSBP2Exec
R
0: Stop
1: Execute
2: PTaskExec
R
0: Stop
1: Execute
1: StTaskExec
R
0: Stop
1: Execute
0: TranExec
R
0: Stop
1: Execute
Hardware SBP2 Status Read Register
This register indicates the execution condition of the hardware SBP2.
Bit7 F/W Pause
When the firmware writes “1” at the HwSBP2Ctl. HwSBP2Pause bit during the execution of the HwSBP2Pause:1
(Pause) HwSBP2, this bit becomes “1”. When the firmware writes “1” at the HwSBP2Ctl.HwSBP2Rsum bit
or resets it, it is cleared. Writing to this bit is ignored.
Bit6 Error Pause
When firmware enters the pause state without writing “1” at the HwSBP2Ctl.HwSBP2Pause bit during the
execution of the HwSBP2Pause:1 (Pause) HwSBP2, this bit becomes “1”. It is cleared at the time of Reset.
Writing to this bit is ignored.
Bit5 NotQuadEnable
This bit specifies whether to generate a 0x32 bit 3 NotQuad interrupt by if SegmentLength of PageTableElement
is not the Quad unit during the HwSBP2 process.
NotQuadEnable: 0 (Disable) Set => A NotQuad interrupt is not generated.
NotQuadEnable: 1 (Enable) Set => A NotQuad interrupt is generated.
* Note that this bit does not indicate the status of HwSBP2.
Bit4 Wait Payload Ready
WaitPLReady:0 (Not Ready) => Payload Domain Not Ready
WaitPLReady:1 (Ready) => Payload Domain Ready
When the IDE interface has a problem, the payload may not be ready. At that time, perform a recovery
processing by the firmware.
Bit3 HwSBP2Exec
HwSBP2Exec:0 (Stop) => Indicates the HwSBP2 processing is completed.
HwSBP2Exec:1 (Execute) => Indicates the HwSBP2 processing is in execution.
It is cleared at the time of Reset. Writing to this bit is ignored..
Bit2 PageTaskExec
PageTaskExec:0 (Stop) => Indicates a PageTask is completed.
PageTaskExec:1 (Execute) => Indicates a PageTask is in execution.
It is cleared at the time of Reset. Writing to this bit is ignored..
Bit1 StreamTaskExec
StreamTaskExec:0 (Stop) => Indicates a StreamTask is completed.
StreamTaskExec:1 (Execute) => Indicates a StreamTask is in execution.
It is cleared at the time of Reset. Writing to this bit is ignored..
Bit0 TranExec.
TranExec:0 (Stop) => Indicates a Transaction is completed.
TranExec:1 (Execute) => Indicates a Transaction is in execution.
It is cleared at the time of Reset. Writing to this bit is ignored..
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