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参数资料
| 型号： | S1R72803F00A100 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | 0.40 MM PITCH, PLASTIC, QFP20-184 |
| 文件页数： | 83/115页 |
| 文件大小： | 833K |
| 代理商： | S1R72803F00A100 |
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S1R72803F00A
EPSON
3
Fig. 3.1 Block diagram
3. INTERNAL BLOCK DESCRIPTION
3.1 BLOCK DIAGRAM
Intenal Packet Memory (8KByte)
Buffer I/F Maneger
IDE
FIFO
DMA
for ATF
DMA
for ITF
DMA
for RF
Rx
FIFO
IsoTx
FIFO
AsyncTx
FIFO
IDE
DMA
Register
for IDE
FLASH ROM
64KByte
(32KWord X 16bit)
Internal
RAM
(8KByte)
C33_CORE
(CPU, BCU, ITC, CLG, DBG)
C33_PERI
(Prescaaler, 8-bit timer, 16bit timer, Clock timer,
Serial interface, Ports)
C33_SBUS
C33 Core Block
C33 peripheral Block
C33 Macro Block
IDE
I/F
TRAN &
SBP2
Control
Register
for TRAN&SBP2
Register
for 1394Tx/Rx
1394
LINK & TRAN
Core
1394
PHY/LINK
I/F
D [7:0]
CTL [1:0]
LREQ
LPS
LINKON
BHEN
XISO
SCLK
Register for
LINK&TRAN
AD [23:0]
DT [15:0]
XCE10_EX
XCE [9:4]
EA10MD [1:0]
XWAIT
EXT_MD
XRD
XWR
XWRH
BCLK
P[14:04]
SRDY
SCLK
SOUT
SIN
HDD [15:0]
HDMARQ
XHIOR
XHIOW
XHDMACK
HIORDY
HINTRQ
XHPDIAG
HDA [2:0]
XCS [1:0]
XHDASP
XHRST
EXCLK_EN
OSC3
PLLS1
PLLS0
ICEMD
DSIO
X2SPD
XNMI
XREST
TVEP
C33
Internal
Memory
Block
CORE
PAD
PERI
PAD
3.2 BLOCK DIAGRAM DESCRIPTION
q C33 CORE Block
The C33 CORE Block consists of the function block-
C33_CORE- that includes the CPU, BCU (bus control
unit), ITC (interrupt controller), CLG (clock
generator), and DBG (debug unit), the external
interface
I/O
pad
block-PAD_CORE,
PAD_CORE_OPTION-, and the block to interface
with the peripheral circuits on the chip -SBUS-.
q C33_PERI Block (C33 peripheral circuit block)
The C33_PERI Block consists of the PSC (prescaler),
6-channel T8 (8-bit programmable timer), WDT
(watch dog timer), 6-channel T16 with an event
counter (16-bit programmable timer), 4-channel SIO
(serial interface), input and I/O ports, and CTM
(clock timer).
q Internal RAM Block
SRAM for the built-in memory area (Area 0).
q Internal Flash Block
Flash for the built-in memory area (Area 10).
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