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参数资料
| 型号： | SME1430LGA-480 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 64-BIT, 480 MHz, RISC PROCESSOR, CBGA587 |
| 封装： | CERAMIC, LGA-587 |
| 文件页数： | 8/60页 |
| 文件大小： | 646K |
| 代理商： | SME1430LGA-480 |
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16
SME1430LGA-360
SME1430LGA-440
SME1430LGA-480
Highly Integrated 64-Bit RISC; L2-Cache, DRAM, PCI Interfaces
UltraSPARC-IIi CPU
May 1999
Sun Microsystems, Inc
Clock Interface Timing Detail [1] [2] [3]
Figure 3. CLKA 1X Mode: Relation of CLKA to Internal, SRAM, and UPA Clocks
Figure 4. CLKA 2X Mode: Relation of CLKA to Internal, SRAM, and UPA Clock
1. See Figure 28 and the table: "Clock Skew" for skew requirements for CLKA.
2. Note that each CLK_POS has a complementary CLK_NEG not shown.
3. During PLLBYPASS, the Internal, SRAM, and UPA Clock relationships must be the same as in CLKA 1X Mode.
1 X Mode, CLKA
CLKSEL = 0
UPA_CLK_POS
SRAM_CLK_POS
Internal CPU CLK
180–240 MHz
90–120 MHz
45–60 MHz
SRAM_CLK_POS
Internal CPU CLK
2 X Mode, CLKA
CLKSEL = 1
180–240 MHz
360–480 MHz
90–120 MHz
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