- 您现在的位置：买卖IC网 > PDF目录195890 > ST72T734J6B1 (意法半导体) 8-BIT USB MCU FOR MONITORS, WITH UP TO 60K OTP, 1K RAM, ADC, TIMER, SYNC, TMU, PWM/BRM, H/W DDC & I2C PDF资料下载
参数资料
| 型号： | ST72T734J6B1 |
| 厂商： | 意法半导体 |
| 元件分类： | ADC |
| 英文描述： | 8-BIT USB MCU FOR MONITORS, WITH UP TO 60K OTP, 1K RAM, ADC, TIMER, SYNC, TMU, PWM/BRM, H/W DDC & I2C |
| 中文描述： | 8位USB单片机的显示器，高达60K章检察官办公室，每1000内存，模数转换器，定时器，同步，材质单元，脉宽调制/的BRM，的H / W DDC的 |
| 文件页数： | 5/144页 |
| 文件大小： | 1280K |
| 代理商： | ST72T734J6B1 |
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ST72774/ST727754/ST72734
102/144
DDC INTERFACE (Cont’d)
DDC2B Mode: The DDC1/2B Interface enters
DDC2B mode either from the transition state or
from the initial state if software sets the HWPE bit
while P&D only or FPDI-2 mode is selected.
Once in DDC2B mode, the Interface always acts
as a slave following the protocol described in
Figure 62.
The DDC1/2B Interface continuously monitors the
SDA and SCL lines for a START condition and will
not respond (no acknowledge) until one is found.
A STOP condition at the end of a Read command
(after a NACK) forces the stand-by state. A STOP
condition at the end of a Write command triggers
the internal DMA write cycle.
The Interface samples the SDA line on the rising
edge of SCL and outputs data on the falling edge
of SCL. In any case SDA can only change when
SCL is low.
Figure 62. DDC2B protocol (example)
SDA
SCL
Start
Ack
A0h
Device Slave
00h
Data Address
Ack
Start A1h
Data1
Ack
DataN
Nack
Stop
Address
Device Slave
Address
128 / 256 bytes EDID
Legend:
Italics = data / control signal from display
Ack
Bold = data / control signal from host
相关PDF资料 |
PDF描述 |
|---|---|
| ST72T754J9B1 | 8-BIT USB MCU FOR MONITORS, WITH UP TO 60K OTP, 1K RAM, ADC, TIMER, SYNC, TMU, PWM/BRM, H/W DDC & I2C |
| ST72T754S9T1 | 8-BIT USB MCU FOR MONITORS, WITH UP TO 60K OTP, 1K RAM, ADC, TIMER, SYNC, TMU, PWM/BRM, H/W DDC & I2C |
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相关代理商/技术参数 |
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