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参数资料
| 型号： | TMX320LF2403AVFS |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | DSP CONTROLLERS |
| 中文描述： | DSP控制器 |
| 文件页数： | 114/134页 |
| 文件大小： | 1759K |
| 代理商： | TMX320LF2403AVFS |
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TMS320LF2407A, TMS320LF2406A, TMS320LF2403A, TMS320LF2402A
TMS320LC2406A, TMS320LC2404A, TMS320LC2403A, TMS320LC2402A
DSP CONTROLLERS
SPRS145K JULY 2000 REVISED AUGUST 2005
80
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
external reference crystal/clock with PLL circuit enabled
timing parameters with the PLL circuit enabled
PARAMETER
MIN
MAX
UNIT
Resonator
4
13
fx
Input clock frequency
Crystal
4
20
MHz
fx
Input clock frequency
CLKIN
4
20
MHz
Input frequency should be adjusted (CLK PS bits in SCSR1 register) such that CLKOUT = 40 MHz maximum, 4 MHz minimum.
switching characteristics over recommended operating conditions [H = 0.5 tc(CO)] (see Figure 26)
PARAMETER
PLL MODE
MIN
TYP
MAX
UNIT
tc(CO)
Cycle time, CLKOUT
×4 mode
25
ns
tf(CO)
Fall time, CLKOUT
4
ns
tr(CO)
Rise time, CLKOUT
4
ns
tw(COL)
Pulse duration, CLKOUT low
H 3
H
H+3
ns
tw(COH)
Pulse duration, CLKOUT high
H 3
H
H+3
ns
tt
Transition time, PLL synchronized after RS pin high
4096tc(Cl)
ns
Input frequency should be adjusted (CLK PS bits in SCSR1 register) such that CLKOUT = 40 MHz maximum, 4 MHz minimum.
timing requirements (see Figure 26)
MIN
MAX
UNIT
tc(Cl)
Cycle time, XTAL1/CLKIN
250
ns
tf(Cl)
Fall time, XTAL1/CLKIN
5
ns
tr(Cl)
Rise time, XTAL1/CLKIN
5
ns
tw(CIL)
Pulse duration, XTAL1/CLKIN low as a percentage of tc(Cl)
40
60
%
tw(CIH)
Pulse duration, XTAL1/CLKIN high as a percentage of tc(Cl)
40
60
%
XTAL1/CLKIN
tc(CI)
tw(CIL)
tw(CIH)
tf(Cl)
tr(Cl)
tc(CO)
tw(COH)
tw(COL) tr(CO)
tf(CO)
CLKOUT
Figure 26. CLKIN-to-CLKOUT Timing with PLL and External Clock in
×4 Mode
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PDF描述 |
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参数描述 |
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