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参数资料
| 型号： | TSX68C000MCB/C12.5A |
| 厂商： | E2V TECHNOLOGIES PLC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 12.5 MHz, MICROPROCESSOR, CDIP64 |
| 封装： | CERAMIC, SDIP-64 |
| 文件页数： | 40/54页 |
| 文件大小： | 901K |
| 代理商： | TSX68C000MCB/C12.5A |
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0853B–HIREL–09/07
e2v semiconductors SAS 2007
TS68C000
Figure 2-15. TS68C000 to EF6800 Peripheral Timing – Worst Case
2.7.6.2
Interrupt Interface Operation
During an interrupt acknowledge cycle while the processor is fetching the vector, the VPA is asserted,
the TS68C000 will assert VMA and complete a normal EF 6800 read cycle as shown in Figure 2-16. The
processor will then use an internally generated vector that is a function of the interrupt being serviced.
This process is know as autovectorlng. The seven autovectors are vector number 25 through 31
(decimal).
Autovectoring operates in the same fashion (but is not restricted to) the EF 6800 interrupt sequence. The
basic difference is that there are six normal interrupt vectors and one NMI type vector. As with bath the
EF 6800 and the TS68C(XX)'s normal vectored interrupt, the Interrupt service routine can be located
any-where in the address space. This is due to the tact that while the vector numbers are fixed the con-
tents of the vector table entries are assigned by the user.
Since VMA is asserted during autovectoring. The EF 6800 peripheral address decoding should prevent
unintended accesses.
S0 S2 S4 wwwwwwwww
w
ww
w
S6 S0
CLK
A1-A23
AS
DTACK
Data Out
Data In
FC0-FC2
E
VPA
VMA
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