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参数资料
| 型号： | TSX68C000MCB/C12.5A |
| 厂商： | E2V TECHNOLOGIES PLC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 12.5 MHz, MICROPROCESSOR, CDIP64 |
| 封装： | CERAMIC, SDIP-64 |
| 文件页数： | 41/54页 |
| 文件大小： | 901K |
| 代理商： | TSX68C000MCB/C12.5A |
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46
0853B–HIREL–09/07
TS68C000
e2v semiconductors SAS 2007
Figure 2-16. Autovector Operation Timing Diagram
Although UDS and LDS are asserted, no data is read from the bus during the autovector cycle. The vec-
tor number is generated internally).
S0 S2 S4 S6 S0 S2 S4 w
w
www
w
S6 S0 S2
CLK
A1-A3
A4-A23
AS
LDS
UDS*
DTACK
FC0-FC2
D0-D7
D8-D15
E
VPA
VMA
IPL0-IPL2
R/W
Autovector Operation
Normal
Cycle
Table 2-13.
Dynamic Electrical Characteristics TS68C000 to EF 6800 Peripheral
Number
Symbol
Parameter
8 MHz
10 MHz
12.5 MHz
Unit
Limits
Min
Max
Min
Max
Min
Max
12
CLSH
Clock low to AS, DS high(1)
70
55
50
ns
18
CHRH
Clock high to R/W high(1)
070060060
ns
20
CHRL
Clock high to R/W low (write)(1)
70
60
ns
23
CLDO
Clock low to data out valid (write)
70
55
ns
27
CLDO
Data in to clock low (set up time on read)(2)
15
10
ns
29
SHDII
AS, DS high to Data in invalid (hold time on
read)
00
0
ns
40
CLVML
AS, DS high to VPA high
70
ns
41
CLET
Clock low to E transition
70
55
45
ns
42
Erf
E output rise and fall time
25
ns
43
VMLEH
VMA low to E high
200
150
90
ns
44
SHVPH
AS, DS high to VPA high
0
120
0
90
0
70
ns
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