参数资料
| 型号： | XRD98L63AIV-F |
| 厂商： | Exar Corporation |
| 文件页数： | 27/41页 |
| 文件大小： | 0K |
| 描述： | IC CCD DIGITIZER 12BIT 48TQFP |
| 标准包装： | 250 |
| 位数： | 12 |
| 通道数： | 1 |
| 电压 - 电源，模拟： | 2.7 V ~ 3.6 V |
| 电压 - 电源，数字： | 2.7 V ~ 3.6 V |
| 封装/外壳： | 48-TQFP |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 托盘 |
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33
Rev.1.01
XRD98L63
2
4
6
8
10
1
3
5
"A" Field
"B" Field
0
1
FSYNC
EOS
CCD
PBLK
CAL
CLAMP
* Line Pattern
Select
Exar
Name
VD
ID
PBLK
OBCLP
CLPDM
7
9
1) PBLK latches EOS value into Line Pattern Select.
1)
CONDITIONS: FSYNCpol=0, PBLKpol=0, CALpol=0, CLAMPpol=0, EOSpol=1
* Internal signals
(Sony Interlaced mode)
TG
Signal
Name
7
2
4
6
8
9
1
3
5
Odd F ield
Even Field
1
0
FSYNC
EOS
CCD
PBLK
CAL
CLAMP
* Line Pattern
Select
Exar
Name
VD
HD
PBLK
CPOB
10
1) FSYNC latches EOS value.
2) PBLK updates Line Pattern Select to the latched EOS value.
1)
2)
1)
2)
HCLR/CLPD
TG
Signal
Name
CONDITIONS: FSYNCpol=1, PBLKpol=1, CALpol=1, CLAMPpol=1, EOSpol=1
* Internal signals
(Panasonic Interlaced mode)
Figure 27. Multiple Gain Mode Timing, Interlaced, MGsel[1:0] = 00
Figure 28. Multiple Gain Mode Timing, Interlaced, MGsel[1:0] = 10
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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