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参数资料
| 型号： | ADSP-TS203SABP-050 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 24/48页 |
| 文件大小： | 0K |
| 描述： | IC DSP FLOAT/FIXED 500MHZ 576BGA |
| 标准包装： | 1 |
| 系列： | TigerSHARC® |
| 类型： | 定点/浮点 |
| 接口： | 主机接口，连接端口，多处理器 |
| 时钟速率： | 500MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 512kB |
| 电压 - 输入/输出： | 2.50V |
| 电压 - 核心： | 1.05V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 576-BBGA 裸露焊盘 |
| 供应商设备封装： | 576-BGA-ED（25x25） |
| 包装： | 托盘 |
| 其它名称： | ADSP-TS203SABP050 ADSP-TS203SABP050-ND |
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Rev. D
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May 2012
Link Port—Data Out Timing
Figure 20, and Figure 21 provide the data out timing for the
LVDS link ports.
Table 32. Link Port—Data Out Timing
Parameter
Description
Min
Max
Unit
Outputs
tREO
Rising Edge (Figure 17)350
ps
tFEO
Falling Edge (Figure 17)350
ps
tLCLKOP
LxCLKOUT Period (Figure 16)
Greater of 4.0 or
0.9 × LCR × tCCLK
1, 2, 3
Smaller of 12.5 or
1.1 × LCR × tCCLK
1, 2, 3
ns
tLCLKOH
LxCLKOUT High (Figure 16)0.4 × tLCLKOP
1
0.6 × tLCLKOP
1
ns
tLCLKOL
LxCLKOUT Low (Figure 16)0.4 × tLCLKOP
1
0.6 × tLCLKOP
1
ns
tCOJT
LxCLKOUT Jitter (Figure 16)±1504, 5, 6
±2507
ps
tLDOS
1, 4, 8
0.25 × LCR × tCCLK –0.15 × tCCLK
1, 5, 6, 8
0.25 × LCR × tCCLK –0.30 × tCCLK
1, 7, 8
ns
tLDOH
1, 4, 8
0.25 × LCR × tCCLK –0.15 × tCCLK
1, 5, 6, 8
0.25 × LCR × tCCLK –0.30 × tCCLK
1, 7, 8
ns
tLACKID
Delay from LxACKI rising edge to first trans-
mission clock edge (Figure 19)
16 × LCR × tCCLK
1, 2
ns
tBCMPOV
LxBCMPO Valid (Figure 19)2 × LCR × tCCLK
1, 2
ns
tBCMPOH
LxBCMPO Hold (Figure 20)3 × TSW – 0.51, 9
ns
Inputs
tLACKIS
LxACKI low setup to guarantee that the trans-
mitter stops transmitting (Figure 20)
LxACKI high setup to guarantee that the trans-
mitter continues its transmission without any
interruption (Figure 21)16 × LCR × tCCLK
1, 2
ns
tLACKIH
LxACKI High Hold Time (Figure 21)0.51
ns
1 Timing is relative to the 0 differential voltage (VOD = 0).
2 LCR (link port clock ratio) = 1, 1.5, 2, or 4. tCCLK is the core period.
3 For the cases of tLCLKOP = 4.0 ns and tLCLKOP = 12.5 ns, the effect of tCOJT specification on output period must be considered.
4 LCR = 1.
5 LCR = 1.5.
6 LCR = 2.
7 LCR = 4.
8 The tLDOS and tLDOH values include LCLKOUT jitter.
9 TSW is a short-word transmission period. For a 4-bit link, it is 2 × LCR × tCCLK. For a 1-bit link, it is 8 × LCR × tCCLK ns.
Figure 16. Link Ports—Output Clock
LxCLKOUT
V
OD =0V
tCOJT
tLCLKOL
tLCLKOH
tLCLKOP
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参数描述 |
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| ADSP-TS203SABPZ050 | 功能描述:IC PROCESSOR 500MHZ 576BGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:TigerSHARC® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
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