参数资料
| 型号： | AFE7222IRGCT |
| 厂商： | Texas Instruments |
| 文件页数： | 87/106页 |
| 文件大小： | 0K |
| 描述： | IC AFE 12BIT 65/130MSPS 64VQFN |
| 标准包装： | 1 |
| 位数： | 12 |
| 通道数： | 4 |
| 功率（瓦特）： | 610mW |
| 电压 - 电源，模拟： | 2.85 V ~ 3.6 V |
| 电压 - 电源，数字： | 1.7 V ~ 1.9 V |
| 封装/外壳： | 64-VFQFN 裸露焊盘 |
| 供应商设备封装： | 64-VQFN 裸露焊盘（9x9） |
| 包装： | 标准包装 |
| 其它名称： | 296-30113-6 |
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SLOS711B – NOVEMBER 2011 – REVISED MARCH 2012
10 DIGITAL INTERFACE
The digital interface is capable of operating in two distinct modes – interleaved parallel CMOS and
serialized LVDS. The supported maximum speed of operation varies depending upon mode in which
digital interface is operating. AFE722x has constraints on maximum frequencies of ADC_CLK and
DAC_CLK. Using these constraints, a comprehensive table showing maximum frequencies of different
clocks in different interfaces is listed in Table 10-1.
The following table shows the maximum frequency of operation of various clocks of AFE7225 in LVDS
interface mode (set register bit REG_LVDS_TX=’1’ to put DAC in LVDS interface mode, and
MASTER_OVERRIDE_RX=’1’ and REG_LVDS_RX=’1’ to put ADC in LVDS interface mode.)
Table 10-1. Maximum Interface Rates in LVDS Mode
RX PATH
Max ADC
SDR or
Decimation Factor
Wire Mode
Sampling
Max ADC Frame Clock
Max ADC Bit Clock
Max Serial Output Data
DDR
(register bits
(register bit
Clock
(ADC_FCLKOUTP/N)
(ADC_DCLKOUTP/N)
Rate (ADCx_DATA_nP/N)
(register bit
RX_DEC_FIL_EN,
TWOWIRE_RX)
(ADC_CLK(1))
MHz
Mbps, per wire
SDR_RX)
RX_DEC_FIL_EN_SRC)
MHz
1
65
390
780
1-wire
DDR
65
2
32.5
195
390
1
125
375
750
2-wire
DDR
125
2
62.5
187.5
375
1
65
390
2-wire
SDR
65
2
32.5
195
TX PATH
SDR or
Interpolation By
Max DAC
Wire Mode
Max DAC Frame Clock
Max DAC Bit Clock
Max Serial Input Data Rate
DDR
(register bits
Output Clock
(register bit
(DAC_FCLKINP/N)
( DAC_DCLKINP/N)
(ADCx_DATA_nP/N)
(register bit
TX_INT_MODE(1:0),
(DAC_CLK(1))
TWOWIRE_TX)
MHz
Mbps, per wire
SDR_TX)
TX_INT_MODE_SRC)
MHz
1
65
390
780
1-wire
DDR
2
130
65
390
780
4
250
62.5
375
750
1
65
390
2-wire
SDR
2
130
65
390
4
250
62.5
375
1
130
390
780
2-wire
DDR
2
250
125
375
780
4
250
62.5
187.5
375
(1)
ADC_CLK and DAC_CLK are derived from clocks on CLKINP and CLKINN (differential clock, a single-ended clock or two independent
single-ended clocks). See Clocking section for details. For Full-Duplex operation requiring two single-ended clocks, see section Full
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DIGITAL INTERFACE
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| AFE7225IRGCR | 功能描述:射频前端 Dual 12B,125MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 类型: 工作频率:2.4 GHz, 5 GHz 最大数据速率:54 Mbps 噪声系数: 工作电源电压:3.3 V 电源电流:180 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-32 |
| AFE7225IRGCT | 功能描述:射频前端 Dual 12B,125MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 类型: 工作频率:2.4 GHz, 5 GHz 最大数据速率:54 Mbps 噪声系数: 工作电源电压:3.3 V 电源电流:180 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-32 |
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