参数资料
| 型号： | DS2154LNA2+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 100/124页 |
| 文件大小： | 0K |
| 描述： | IC TXRX E1 5V 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | E1 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
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DS21354/DS21554 3.3V/5V E1 Single-Chip Transceivers
77 of 124
THIR: TRANSMIT HDLC INFORMATION REGISTER (Address = B6 Hex)
(MSB)
(LSB)
—
TEMPTY
TFULL
TUDR
SYMBOL
POSITION
NAME AND DESCRIPTION
—
THIR.7
Not Assigned. Could be any value when read.
—
THIR.6
Not Assigned. Could be any value when read.
—
THIR.5
Not Assigned. Could be any value when read.
—
THIR.4
Not Assigned. Could be any value when read.
—
THIR.3
Not Assigned. Could be any value when read.
TEMPTY
THIR.2
Transmit FIFO Empty. A real-time bit that is set high when the FIFO is
empty.
TFULL
THIR.1
Transmit FIFO Full. A real-time bit that is set high when the FIFO is
full.
TUDR
THIR.0
Transmit FIFO Underrun. Set when the transmit FIFO empties out
without the TEOM control bit being set. An abort is automatically sent.
Note: The TUDR bit is latched and is cleared when read.
THFR: TRANSMIT HDLC FIFO REGISTER (Address = B7 Hex)
(MSB)
(LSB)
HDLC7
HDLC6
HDLC5
HDLC4
HDLC3
HDLC2
HDLC1
HDLC0
SYMBOL
POSITION
NAME AND DESCRIPTION
HDLC7
THFR.7
HDLC Data Bit 7. MSB of a HDLC packet data byte.
HDLC6
THFR.6
HDLC Data Bit 6.
HDLC5
THFR.5
HDLC Data Bit 5.
HDLC4
THFR.4
HDLC Data Bit 4.
HDLC3
THFR.3
HDLC Data Bit 3.
HDLC2
THFR.2
HDLC Data Bit 2.
HDLC1
THFR.1
HDLC Data Bit 1.
HDLC0
THFR.0
HDLC Data Bit 0. LSB of a HDLC packet data byte.
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PDF描述 |
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参数描述 |
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