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参数资料
| 型号： | DS3131 |
| 厂商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分类： | Telecom IC:Other |
| 英文描述： | SPECIALTY TELECOM CIRCUIT, PBGA256 |
| 封装： | 27 X 27 MM, PLASTIC, BGA-256 |
| 文件页数： | 76/174页 |
| 文件大小： | 1261K |
| 代理商： | DS3131 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页当前第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页
DS3131
167 of 174
AC CHARACTERISTICS: PCI BUS INTERFACE
(VDD = 3.0V to 3.6V, TA = 0°C to +70°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
PCLK Period
t1
(Note 11)
30
40
ns
PCLK Low Time
t2
12
ns
PCLK High Time
t3
12
ns
All PCI Inputs and I/O Setup Time to the
Rising Edge of PCLK
t4
7
ns
All PCI Inputs and I/O Hold Time from the
Rising Edge of PCLK
t5
(Note 12)
1
ns
Delay from the Rising Edge of PCLK to
Data Valid on all PCI Outputs and I/O
t6
2
11
ns
Delay from the Rising Edge of PCLK to
Three-state on all PCI Outputs and I/O
t7
28
ns
Delay from the Rising Edge of PCLK to
Data Valid from Three-state on all PCI
Outputs and I/O
t8
2
ns
Note 11:
Aggregate, maximum bandwidth and port speed for the DS3131 are directly proportional to PCLK frequency. With a PCLK of 40ns, for
example, the minimum layer one port clock period (t1) is derated to 20ns.
Note 12:
The PCI 2.1 Specification dictates that t5 should be 0ns. The 1ns value is noncompliance; however, this should not present an issue in
a real-world board design.
Figure 13-5. PCI Bus Interface AC Timing Diagram
Data Valid
PCLK
PCI Input
and I/O
PCI Output
and I/O
PCI Output and
I/O to Three-state
PCI Output and
I/O from Three-state
Data Valid
Three-state
t4
t5
t6
t7
t8
t1
t2
t3
相关PDF资料 |
PDF描述 |
|---|---|
| DS3134 | DATACOM, FRAMER, PBGA256 |
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相关代理商/技术参数 |
参数描述 |
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