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参数资料
| 型号： | GT- 32090 |
| 厂商： | Galileo Technology Services, LLC |
| 英文描述： | Highly Integrated Single-Chip System Controller(高集成单片系统控制器) |
| 中文描述： | 高度集成的单芯片系统控制器（高集成单片系统控制器） |
| 文件页数： | 14/67页 |
| 文件大小： | 524K |
| 代理商： | GT- 32090 |
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GT-32090 System Controller For i960JX Processors
21
Galileo
Technology, Inc.
3.8
DMA Record
Each DMA channel record includes four registers: byte count, source address, destination address, and a pointer to the
next record. The active record can be written by the CPU, or by the DMA controller in the process of fetching a new
record from memory. The structure of the record is illustrated in the following example:
Channel 0 DMA Byte Count, Offset: 0x800
Channel 1 DMA Byte Count, Offset: 0x804
GT-32090 Channel 0 DMA Registers
Byte Count (ByteCt)
Source Address (SrcAdd)
Destination Address (DestAdd)
Next Record Pointer (NextRecPtr): 0x10
0x10
ByteCt
0x14
SrcAdd
0x18
DestAdd
0x1c
NextRecPtr: 0x100
0x100
ByteCt
0x104
SrcAdd
0x108
DestAdd
0x10c
NextRecPtr: y
x
ByteCt
x
SrcAdd
x
DestAdd
x
NULL Pointer: 0x0
Bits
Field Name
Function
Initial Value
15:0
ByteCt
The number of bytes that are left in DMA transfers.
0x0
Bits
Field Name
Function
Initial Value
15:0
ByteCt
The number of bytes that are left in DMA transfers.
0x0
Transfer #1
Transfer #2
Transfer #n
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