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参数资料
| 型号： | HMC703LP4E |
| 厂商： | Hittite Microwave Corporation |
| 文件页数： | 24/58页 |
| 文件大小： | 0K |
| 描述： | IC FRACT-N PLL W/SWEEPR 24QFN |
| 标准包装： | 1 |
| 类型： | 整数 N/小数 N 分频 |
| PLL： | 是 |
| 输入： | CMOS |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 8GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.3V，5V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VQFN 裸露焊盘 |
| 供应商设备封装： | 24-QFN 裸露焊盘（4x4） |
| 包装： | 标准包装 |
| 其它名称： | 1127-1065-6 |
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p
ll
s
-
s
M
T
6 - 30
HMC703LP4E
v02.0813
8 GHz fractional syntHesizer
For price, delivery and to place orders: Hittite Microwave Corporation, 2 Elizabeth Drive, Chelmsford, MA 01824
978-250-3343 978-250-3373 fax Order On-line at www.hittite.com
Application Support: pll@hittite.com
reference input stage
The reference buffer provides the path from an external reference source (generally crystal based) to the R divider, and
eventually to the phase detector. The buffer has two modes of operation. High Gain (recommended below 200 MHz),
and High frequency, for 200 to 350 MHz operation. The buffer is internally DC biased, with 100 internal termination.
For 50 match, an external 100 resistance to AC ground should be added, followed by an AC coupling capacitance
(impedance < 1 Ohm), then to the XREFP pin of the part.
At low frequencies, a relatively square reference is recommended to keep the input slew rate high. At higher frequencies,
a square or sinusoid can be used. The following table shows the recommended operating regions for different reference
frequencies. If operating outside these regions the part will normally still operate, but with degraded performance.
Minimum pulse width at the reference buffer input is 2.5 ns. For best spur performance when R = 1, the pulse width
should be > (2.5 ns + 8 Tps), where Tps is the period of the VCO at the prescaler input. When R > 1 minimum pulse
width is 2.5 ns.
table 7. reference sensitivity table
square Input
sinusoidal Input
Frequency
(MHz)
slew > 0.5V/ns
Recommended swing (Vpp)
Recommended Power Range (dBm)
Recommended
Min
Max
Recommended
Min
Max
< 10
YEs
0.6
2.5
x
10
YEs
0.6
2.5
x
25
YEs
0.6
2.5
ok
8
15
50
YEs
0.6
2.5
YEs
6
15
100
YEs
0.6
2.5
YEs
5
15
150
ok
0.9
2.5
YEs
4
12
200
ok
1.2
2.5
YEs
3
8
200 to 350
x
YEs1
5
10
Note: For greater than 200 MHz operation, use buffer in High Frequency Mode. Reg 08h[18] = 1
Input referred phase noise of the PLL when operating at 50 MHz is between -150 and -156 dBc/Hz at 10 kHz offset
depending upon the mode of operation. The input reference signal should be 10dB better than this floor to avoid deg-
radation of the PLL noise contribution. It should be noted that such low levels are only necessary if the PLL is the
dominant noise contributor and these levels are required for the system goals.
Figure 35. Reference Path Input Stage
相关PDF资料 |
PDF描述 |
|---|---|
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| HMC830LP6GE | IC FRACT-N PLL W/VCO 40QFN |
| HMP8117CNZ | IC VIDEO DECODER NTSC/PAL 80PQFP |
| HMP8156ACNZ | IC VIDEO ENCODER NTSC/PAL 64MQFP |
| HSP45102SC-40Z | IC OSC NCO 40MHZ 28-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| HMC7044LP10BETR | 功能描述:IC JITTER ATTENUATOR 68LFCSP 制造商:analog devices inc. 系列:- 包装:剪切带（CT） 零件状态:在售 类型:漂移衰减器 PLL:是 输入:CML，CMOS，LVDS，LVPECL 输出:CML，LVDS，LVPECL 电路数:1 比率 - 输入:输出:4:14 差分 - 输入:输出:是/是 频率 - 最大值:3.2GHz 分频器/倍频器:是/无 电压 - 电源:3.135 V ~ 3.465 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:68-VFQFN 裸露焊盘，CSP 供应商器件封装:68-LFCSP-VQ（10x10） 标准包装:1 |
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