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参数资料
| 型号： | HMC703LP4E |
| 厂商： | Hittite Microwave Corporation |
| 文件页数： | 43/58页 |
| 文件大小： | 0K |
| 描述： | IC FRACT-N PLL W/SWEEPR 24QFN |
| 标准包装： | 1 |
| 类型： | 整数 N/小数 N 分频 |
| PLL： | 是 |
| 输入： | CMOS |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 8GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.3V，5V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VQFN 裸露焊盘 |
| 供应商设备封装： | 24-QFN 裸露焊盘（4x4） |
| 包装： | 标准包装 |
| 其它名称： | 1127-1065-6 |
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p
ll
s
-
s
M
T
6 - 48
HMC703LP4E
v02.0813
8 GHz fractional syntHesizer
For price, delivery and to place orders: Hittite Microwave Corporation, 2 Elizabeth Drive, Chelmsford, MA 01824
978-250-3343 978-250-3373 fax Order On-line at www.hittite.com
Application Support: pll@hittite.com
table 20. reg 07h lock Detect register
BIT
TYPE
NAME
W
DEFLT
DEsCRIPTION
[2:0]
R/W
LKDCounts
3
5
Lock Detect window
sets the number of consecutive counts of divided VCO that must
land inside the Lock Detect Window to declare LOCK
0: 5
1: 32
2: 96
3: 256
4: 512
5: 2048
6: 8192
7: 65535
[10:3]
R/W
Reserved
8
12d
Program 12d
[11]
R/W
LockDetect Counters Enable
1
Enable Lock Detect Counters (R07[14] should also = 1)
[13:12]
R/W
Reserved
2
0
Program 0
[14]
R/W
Lock Detect Timer Enable
1
Enable Lock Detect Timer (R07[11] should also = 1)
[15]
R/W
Cycle slip Prevention Enable
1
0
Increases Charge Pump gain for phase errors larger than lock-
detect timer.
[19:16]
R/W
Reserved 0
4
0
Reserved
[20]
R/W
Train Lock Detect Timer
1
0
This bit must be programmed from 0 to 1 after a change of PD
reference clock frequency (via either the external reference or a
change to the Rdivider).
[21]
R/W
Reserved
1
0
Reserved - Program to 1
table 21. reg 08h analog en register
BIT
TYPE
NAME
W
DEFLT
DEsCRIPTION
[0]
R/W
EnBias
1
Bias
[1]
R/W
EnCP
1
Charge-Pump
[2]
R/W
EnPFD
1
PFD
[3]
R/W
EnXtal
1
Reference Buffer
[4]
R/W
EnVCO
1
VCO Buffer
[5]
R/W
EnGPO
1
GPO Output Buffer Enable (If 0 the buffer is HiZ, if 1 the buffer MAY
be HiZ depending on GPOsel and sPI activity)
[6]
R/W
EnMcnt
1
Mcounter
[7]
R/W
EnPs
1
Prescaler
[8]
R/W
EnVCOBias
1
VCO Divider Related Biases
[9]
R/W
EnOpAmp
1
Charge-Pump Amplifier
[12:10]
R/W
VCOOutBiasA
3
RF Divider Bias A sel
[15:13]
R/W
VCOOutBiasB
3
RF Divider Bias B sel
[16]
R/W
VCOBWsel
1
RF Buffer Bias sel
[17]
R/W
RFDiv2sel
1
0
Enables RF Divide/2
[18]
R/W
XtalLowGain
1
0
Lowers the gain (and extends BW) of the XTAL buffer
[19]
R/W
XtalDissat
1
0
Disables saturation protection on the XTAL buffer
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PDF描述 |
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