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参数资料
| 型号： | HMC703LP4E |
| 厂商： | Hittite Microwave Corporation |
| 文件页数： | 36/58页 |
| 文件大小： | 0K |
| 描述： | IC FRACT-N PLL W/SWEEPR 24QFN |
| 标准包装： | 1 |
| 类型： | 整数 N/小数 N 分频 |
| PLL： | 是 |
| 输入： | CMOS |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 8GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.3V，5V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-VQFN 裸露焊盘 |
| 供应商设备封装： | 24-QFN 裸露焊盘（4x4） |
| 包装： | 标准包装 |
| 其它名称： | 1127-1065-6 |
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P
LL
s
-
s
M
T
6 - 41
HMC703LP4E
v02.0813
8 GHz fractional syntHesizer
For price, delivery and to place orders: Hittite Microwave Corporation, 2 Elizabeth Drive, Chelmsford, MA 01824
978-250-3343 978-250-3373 fax Order On-line at www.hittite.com
Application Support: pll@hittite.com
HMc Mode - serial Port reaD operation
A typical HMC Mode READ cycle is shown in Figure 42.
a. The Master (host) asserts both sEN (serial Port Enable) and sDI to indicate a READ cycle, followed
by a rising edge sCK. Note: The Lock Detect (LD) function is usually multiplexed onto the LD_sDO
pin. It is suggested that LD only be considered valid when sEN is low. In fact LD will not toggle until
the first active data bit toggles on LD_sDO, and will be restored immediately after the trailing edge
of the LsB of serial data out as shown in Figure 42.
b. The slave (synthesizer) reads sDI on the 1st rising edge of sCK after sEN. sDI high initiates the
READ cycle (RD)
c. Host places the six address bits on the next six falling edges of sCK, MsB first.
d. slave registers the address bits on the next six rising edges of sCK (2-7).
e. slave switches from Lock Detect and places the requested 24 data bits on sD_LDO on the next 24
rising edges of sCK (8-31), MsB first .
f.
Host registers the data bits on the next 24 falling edges of sCK (8-31).
g. slave restores Lock Detect on the 32nd rising edge of sCK.
h. sEN is cleared after a minimum delay of t6. This completes the cycle.
table 10. sPi HMc Mode - read timing characteristics
Parameter
Conditions
Min.
Typ.
Max.
Units
t1
t2
t3
t4
t5
t6
sEN to sCK setup time
sDI setup to sCK time
sCK to sDI hold time
sEN low duration
sCK to sDO delay
sCK to sEN fall
8
3
20
10
8.2ns+0.2ns/pF
ns
Figure 42. HMC Mode Serial Port Timing Diagram - READ
相关PDF资料 |
PDF描述 |
|---|---|
| HMC704LP4E | IC FRACT-N PLL 16BIT 24QFN |
| HMC830LP6GE | IC FRACT-N PLL W/VCO 40QFN |
| HMP8117CNZ | IC VIDEO DECODER NTSC/PAL 80PQFP |
| HMP8156ACNZ | IC VIDEO ENCODER NTSC/PAL 64MQFP |
| HSP45102SC-40Z | IC OSC NCO 40MHZ 28-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| HMC703LP4ETR | 制造商:Hittite Microwave Corp 功能描述:IC FRACT-N PLL W/SWEEPR 24QFN 制造商:Hittite Microwave Corp 功能描述:8 GHz Fractional-N PLL with Sweeper |
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| HMC7044LP10BETR | 功能描述:IC JITTER ATTENUATOR 68LFCSP 制造商:analog devices inc. 系列:- 包装:剪切带（CT） 零件状态:在售 类型:漂移衰减器 PLL:是 输入:CML，CMOS，LVDS，LVPECL 输出:CML，LVDS，LVPECL 电路数:1 比率 - 输入:输出:4:14 差分 - 输入:输出:是/是 频率 - 最大值:3.2GHz 分频器/倍频器:是/无 电压 - 电源:3.135 V ~ 3.465 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:68-VFQFN 裸露焊盘，CSP 供应商器件封装:68-LFCSP-VQ（10x10） 标准包装:1 |
| HMC704LP4E | 功能描述:IC FRACT-N PLL 16BIT 24QFN RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:2,000 系列:- 类型:PLL 频率合成器 PLL:是 输入:晶体 输出:时钟 电路数:1 比率 - 输入:输出:1:1 差分 - 输入:输出:无/无 频率 - 最大:1GHz 除法器/乘法器:是/无 电源电压:4.5 V ~ 5.5 V 工作温度:-20°C ~ 85°C 安装类型:表面贴装 封装/外壳:16-LSSOP（0.175"，4.40mm 宽） 供应商设备封装:16-SSOP 包装:带卷 (TR) 其它名称:NJW1504V-TE1-NDNJW1504V-TE1TR |
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