参数资料
型号: IDT82V3280PF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 通信及网络
英文描述: WAN PLL
中文描述: SPECIALTY TELECOM CIRCUIT, PQFP100
封装: TQFP-100
文件页数: 70/167页
文件大小: 1039K
代理商: IDT82V3280PF
IDT82V3280
WAN PLL
Programming Information
70
June 19, 2006
DIFFERENTIAL_IN_OUT_OSCI_CNFG - Differential Input / Output Port & Master Clock Configuration
Address: 0AH
Type: Read / Write
Default Value: XXXXX001
Bit
Name
Description
7 - 3
-
Reserved.
This bit selects a better active edge of the master clock.
0: The rising edge. (default)
1: The falling edge.
This bit selects a port technology for OUT7.
0: LVDS. (default)
1: PECL.
This bit selects a port technology for OUT6.
0: LVDS.
1: PECL. (default)
2
OSC_EDGE
1
OUT7_PECL_LVDS
0
OUT6_PECL_LVDS
7
6
5
4
3
2
1
0
-
-
-
-
-
OSC_EDGE
OUT7_PECL_LVDS
OUT6_PECL_LVDS
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