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参数资料
| 型号： | ISP1181ABS,551 |
| 厂商： | ST-ERICSSON |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC48 |
| 封装： | 7 X 7 MM, 0.85 MM HEIGHT, PLASTIC, MO-220, SOT-619-2, HVQFN-48 |
| 文件页数： | 22/70页 |
| 文件大小： | 341K |
| 代理商： | ISP1181ABS,551 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页当前第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页
Philips Semiconductors
ISP1181A
Full-speed USB peripheral controller
Product data
Rev. 05 — 08 December 2004
29 of 70
9397 750 13959
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
12.1.5
Write/Read Interrupt Enable Register
This command is used to individually enable/disable interrupts from all endpoints, as
well as interrupts caused by events on the USB bus (SOF, SOF lost, EOT, suspend,
resume, reset). A bus reset will not change any of the programmed bit values.
The command accesses the Interrupt Enable Register, which consists of 4 bytes. The
bit allocation is given in Table 22.
Code (Hex): C2/C3 — write/read Interrupt Enable Register
Transaction — write/read 4 bytes
6
DRQPOL
Selects DREQ signal polarity (0 = active LOW, 1 = active
HIGH). Bus reset value: unchanged.
5
DAKPOL
Selects DACK signal polarity (0 = active LOW, 1 = active HIGH).
Bus reset value: unchanged.
4
EOTPOL
Selects EOT signal polarity (0 = active LOW, 1 = active HIGH).
Bus reset value: unchanged.
3
WKUPCS
A logic 1 enables remote wake-up via a LOW level on input CS
(For wake-up on CS to work, VBUS must be present.).
Bus reset value: unchanged.
2
PWROFF
A logic 1 enables powering-off during ‘suspend’ state. Output
SUSPEND is congured as a power switch control signal for
external devices (HIGH during ‘suspend’). This value should
always be initialized to logic 1. Bus reset value: unchanged.
1
INTLVL
Selects the interrupt signalling mode on output INT (0 = level,
1 = pulsed). In pulsed mode an interrupt produces an 166 ns
pulse. See Section 13 for details. Bus reset value: unchanged.
0
INTPOL
Selects INT signal polarity (0 = active LOW, 1 = active HIGH).
Bus reset value: unchanged.
Table 21:
Hardware Conguration Register: bit description…continued
Bit
Symbol
Description
Table 22:
Interrupt Enable Register: bit allocation
Bit
31
30
29
28
27
26
25
24
Symbol
reserved
Reset
00000000
Access
R/W
Bit
23
22
21
20
19
18
17
16
Symbol
IEP14
IEP13
IEP12
IEP11
IEP10
IEP9
IEP8
IEP7
Reset
00000000
Access
R/W
Bit
15
14
13
12
11
10
9
8
Symbol
IEP6
IEP5
IEP4
IEP3
IEP2
IEP1
IEP0IN
IEP0OUT
Reset
00000000
Access
R/W
相关PDF资料 |
PDF描述 |
|---|---|
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| M30625FGNGP | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP80 |
| M306K7F8LRP | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP144 |
| M35052-001FP | 24 X 10 CHARACTERS CRT CHAR DSPL CTLR, PDSO20 |
相关代理商/技术参数 |
参数描述 |
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