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参数资料
| 型号： | ISP1181ABS,551 |
| 厂商： | ST-ERICSSON |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC48 |
| 封装： | 7 X 7 MM, 0.85 MM HEIGHT, PLASTIC, MO-220, SOT-619-2, HVQFN-48 |
| 文件页数： | 35/70页 |
| 文件大小： | 341K |
| 代理商： | ISP1181ABS,551 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页当前第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页
Philips Semiconductors
ISP1181A
Full-speed USB peripheral controller
Product data
Rev. 05 — 08 December 2004
40 of 70
9397 750 13959
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
12.3.6
Read Interrupt Register
This command indicates the sources of interrupts as stored in the 4-byte Interrupt
Register. Each individual endpoint has its own interrupt bit. The bit allocation of the
Interrupt Register is shown in Table 48. Bit BUSTATUS is used to verify the current
bus status in the interrupt service routine. Interrupts are enabled via the Interrupt
Enable Register, see Section 12.1.5.
While reading the interrupt register, read all the 4 bytes completely.
Code (Hex): C0 — read interrupt register
Transaction — read 4 bytes
Bit
7
6
5
4
3
2
1
0
Symbol
CHIPIDL[7:0]
Reset
41H
Access
RRRRRRRR
Table 47:
Chip ID Register: bit description
Bit
Symbol
Description
15 to 8
CHIPIDH[7:0]
chip ID code (81H)
7 to 0
CHIPIDL[7:0]
silicon version (41H, with 41H representing the BCD encoded
version number)
Table 48:
Interrupt Register: bit allocation
Bit
31
30
29
28
27
26
25
24
Symbol
reserved
Reset
00000000
Access
RRRRRRRR
Bit
23
22
21
20
19
18
17
16
Symbol
EP14
EP13
EP12
EP11
EP10
EP9
EP8
EP7
Reset
00000000
Access
RRRRRRRR
Bit
15
14
13
12
11
10
9
8
Symbol
EP6
EP5
EP4
EP3
EP2
EP1
EP0IN
EP0OUT
Reset
00000000
Access
RRRRRRRR
Bit
7
6
5
4
3
2
1
0
Symbol
BUSTATUS
reserved
PSOF
SOF
EOT
SUSPND
RESUME
RESET
Reset
00000000
Access
RRRRRRRR
Table 49:
Interrupt Register: bit description
Bit
Symbol
Description
31 to 24
-
reserved
23 to 10
EP14 to EP1
A logic 1 indicates the interrupt source(s): endpoint 14 to 1.
9
EP0IN
A logic 1 indicates the interrupt source: control IN endpoint.
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